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EEPW首頁 >> 主題列表 >> 現(xiàn)場可編程門陣列(fpga)

賽靈思發(fā)布ISE12.2強化部分可重配置FPGA技術(shù)

  • 　　全球可編程平臺領(lǐng)導(dǎo)廠商賽靈思公司(Xilinx, Inc. (NASDAQ:XLNX) )今天宣布推出其第四代部分可重配置設(shè)計流程，以及智能時鐘門控技術(shù)的多項全新強化方案，可針對Virtex™®-6 FPGA設(shè)計中BRAM(block-RAM)降低24%的動態(tài)功耗。設(shè)計人員即日起即可下載ISE12.2設(shè)計套件，利用其簡便易用、直觀的部分可重配置設(shè)計流程，進(jìn)一步降低功耗和整體系統(tǒng)成本。同時，最新推出的ISE版本還可提供一項低成本仿真方案， 支持嵌入式設(shè)計流程。 　　賽靈思 ISE
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并行NOR Flash在SOPC開發(fā)中的應(yīng)用設(shè)計

  • 引言隨著FPGA技術(shù)的發(fā)展，出現(xiàn)了一種新概念的嵌入式系統(tǒng)，即SOPC（SystemOnProgrammableChip）。SOPC技...
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賽靈思發(fā)布提高了抗輻射性和性能的航天用FPGA

  • 　　美國賽靈思(Xilinx)發(fā)布了抗輻射性和性能均高于其原產(chǎn)品的航天領(lǐng)域用FPGA“Virtex-5QV FPGA”。將耐輻射總劑量(TID)提高到了該公司原產(chǎn)品的2倍以上之外，其規(guī)模也達(dá)到了13萬個邏輯單元，作為航天領(lǐng)域用FPGA中屬業(yè)界最高水準(zhǔn)。此外，還集成了最高速度為3.125Gbit/秒的高速收發(fā)器，并強化了DSP功能。主要面向人造衛(wèi)星和宇宙飛船上的遙感處理、圖像處理以及導(dǎo)航儀等用途。目前正在樣品供貨，將從2011年1～3月開始65nm工藝的量產(chǎn)。賽靈思表示：&ldquo
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針對GPON突發(fā)模式接收器的低功耗FPGA方案

  • 帶服務(wù)能夠支持三重應(yīng)用（即支持語音、視頻和數(shù)據(jù)）至第一英里的客戶，例如持續(xù)發(fā)展的小商業(yè)和住宅。FTTx中的...
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用FPGA構(gòu)建PCI Express端點器件最佳平臺

  • PCIExpress是一種使用時鐘數(shù)據(jù)恢復(fù)(CDR)技術(shù)的高速串行I/O互連機制。PCIExpress第一代規(guī)范規(guī)定的線速...
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DDR3存儲器接口控制器IP加速數(shù)據(jù)處理應(yīng)用

  • DDR3存儲器系統(tǒng)可以大大提升各種數(shù)據(jù)處理應(yīng)用的性能。然而，和過去幾代（DDR和DDR2）器件相比，DDR3存儲器器件...
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圖像自適應(yīng)分段線性拉伸算法的FPGA設(shè)計

  • 為改善紅外圖像的視覺效果和后續(xù)處理質(zhì)量，需要對圖像進(jìn)行增強處理。在此介紹并實現(xiàn)了一種空間域圖像增強算法，自適應(yīng)分段線性拉伸算法。首先簡要分析算法原理，對該算法基于Xilinx公司XC4VLXl5系列FPGA的實現(xiàn)方法進(jìn)行了研究，以兼顧系統(tǒng)實時性和集成度為目的，提出灰度直方圖統(tǒng)計和拉伸運算等關(guān)鍵模塊的解決方案。通過試驗結(jié)果分析，對壓縮因子的選取提出建議。該設(shè)計的輸出延遲僅為62.-5ns，且具有實現(xiàn)簡單、集成度高、功耗低等優(yōu)點，適合在精確制導(dǎo)武器和導(dǎo)航系統(tǒng)中應(yīng)用。
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增量型光電編碼器抗抖動二倍頻電路的設(shè)計

  • 在某些工業(yè)自動控制領(lǐng)域、某些裝備應(yīng)用上，經(jīng)常會遇到各種需要測量長度的場合，目前通常采用的是光電編碼器...
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基于DSP的風(fēng)電場電能質(zhì)量監(jiān)測裝置研究設(shè)計

  • 隨著全世界新能源風(fēng)力發(fā)電的大力發(fā)展，電能質(zhì)量的監(jiān)測成為風(fēng)電場的研究熱點。風(fēng)電場電能質(zhì)量問題可以分為...
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基于DSP和FPGA的實時圖像壓縮系統(tǒng)設(shè)計

  • 提出了一種基于高頻幀攝像頭的高頻幀實時圖像壓縮技術(shù)，以此技術(shù)為基礎(chǔ)，使用TMS320CDM642和EP2C35 FPGA相結(jié)合，設(shè)計了一種高頻幀實時圖像處理器硬件系統(tǒng)。該系統(tǒng)采用2片SRAM乒乓結(jié)構(gòu)，以及基于TI公司DSP/BIOS和支持XDAIS的JPEG2000壓縮算法，實現(xiàn)了100幀/s的壓縮速度，系統(tǒng)同時解決了圖像壓縮中容量和速度的問題，實驗了采集和壓縮過程的同步進(jìn)行，大大提高了圖像壓縮速度。
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基于FPGA的移位寄存器流水線結(jié)構(gòu)FFT處理器

  • 0引言快速傅里葉變換(FFT)在雷達(dá)、通信和電子對抗等領(lǐng)域有廣泛應(yīng)用。近年來現(xiàn)場可編程門陣列(FPG...
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基于CPLD器件的單穩(wěn)態(tài)脈沖展寬電路的設(shè)計

  • 在數(shù)字電路設(shè)計中，當(dāng)需要將一輸入的窄脈沖信號展寬成具有一定寬度和精度的寬脈沖信號時，往往很快就想到利...
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利用Virtex-5LXT應(yīng)對串行背板接口設(shè)計挑戰(zhàn)

  • 采用串行技術(shù)進(jìn)行高端系統(tǒng)設(shè)計已占很大比例。在《EETimes》雜志最近開展的一次問卷調(diào)查中，有92%的受訪者...
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基于VHDL語言的99小時定時器設(shè)計及實現(xiàn)

  • 0引言傳統(tǒng)的定時器硬件連接比較復(fù)雜，可靠性差，而且計時時間短，難以滿足需要。本設(shè)計采用可編程芯片...
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可編程ASIC器件主從式下載開發(fā)系統(tǒng)的設(shè)計

  • 1引言當(dāng)前在EDA領(lǐng)域，只要具備臺式或筆記本電腦并裝有工具軟件，就可以方便地對可編程ASIC（CPLD/FPGA）...
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現(xiàn)場可編程門陣列(fpga)介紹

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