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EEPW首頁 >> 主題列表 >> cpld／fpga

基于FPGA的LED點陣顯示字符的設(shè)計原理分析

  • 隨著社會的發(fā)展和信息時代對各類信息快速發(fā)布的需要， 許多政府部門和企事業(yè)單位從提高自身形象和信息規(guī)范化管理考慮， 廣泛采用LED 電子顯示屏顯示產(chǎn)品， 此類多媒體顯示系統(tǒng)通過一定的控制方式，用于顯示文字、圖形
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基于CPLD的系統(tǒng)硬件看門狗設(shè)計

  • 摘要：基于以DSP芯片TMS320F2812為核心的數(shù)字伺服控制器，以國微電子公司的SM1032國產(chǎn)CPLD(兼容Lattice公司的ispLSI 1032)為載體，設(shè)計了專用的系統(tǒng)硬件看門狗模塊，具備識別DSP軟件初始化時序、自由定制看門狗時序等
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FPGA設(shè)計及調(diào)試問題分析

  • FPGA設(shè)計及調(diào)試問題分析,現(xiàn)代科技對系統(tǒng)的可靠性提出了更高的要求，而FPGA技術(shù)在電子系統(tǒng)中應(yīng)用已經(jīng)非常廣泛，因此FPGA易測試性就變得很重要。要獲得的FPGA內(nèi)部信號十分有限、FPGA封裝和印刷電路板(PCB)電氣噪聲，這一切使得設(shè)計調(diào)試和檢驗變
  • 關(guān)鍵字： 分析  問題  調(diào)試  設(shè)計  FPGA  

基于FPGA及DSP Builder的VGA接口時序和系統(tǒng)設(shè)計

  • 基于FPGA及DSP Builder的VGA接口時序和系統(tǒng)設(shè)計,本文基于DSP Builder的VGA接口設(shè)計方法，對VGA接口時序和系統(tǒng)設(shè)計需求進行了介紹，并在硬件平臺下實現(xiàn)一維與二維信號的顯示。

    VGA接口標(biāo)準(zhǔn)

    VGA顯像原理

    顯示器通過光柵掃描的方式，電子束在顯示屏幕上
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基于SRAM工藝FPGA的加密方法介紹

  • 在現(xiàn)代電子系統(tǒng)設(shè)計中，由于可編程邏輯器件的卓越性能、靈活方便的可升級特性，而得到了廣泛的應(yīng)用。由于大規(guī)模高密度可編程邏輯器件多采用SRAM工藝，要求每次上電，對FPGA器件進行重配置，這就使得可以通過監(jiān)視配置
  • 關(guān)鍵字： 方法  介紹  加密  FPGA  SRAM  工藝  基于  

基于FPGA的四階IIR數(shù)字濾波器設(shè)計

  • 摘要：采用FPGA實現(xiàn)四階IIR數(shù)字濾波器，通過兩個二階節(jié)級聯(lián)構(gòu)成數(shù)字橢圓低通濾波器。通帶內(nèi)波紋小于0.1dB，阻帶衰減大于32dB。 常用的數(shù)字濾波器有ＦＩＲ數(shù)字濾波器和ＩＩＲ數(shù)字濾波器。ＦＩＲ數(shù)字濾波器具有精確
  • 關(guān)鍵字： 濾波器  設(shè)計  數(shù)字  IIR  FPGA  基于  

基于FPGA和DSP的1394b雙向數(shù)據(jù)傳輸系統(tǒng)

  • 摘要：IEEE 1394串行總線以其高速實時性的特點和靈活可配置的拓撲結(jié)構(gòu)為提高系統(tǒng)性能提供了一種有效的途徑。文中介紹了IEEE Std 1394b總線系統(tǒng)的功能和特點，并以FPGA和DSP為控制核心設(shè)計了1394b雙向數(shù)據(jù)總線傳輸系統(tǒng)
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基于FPGA的生命探測儀算法研究與系統(tǒng)設(shè)計

  • 摘要：給出了一種基于FPGA的生命探測信號處理系統(tǒng)的設(shè)計方法。從理論上研究了生命探測儀的算法及其軟硬件系統(tǒng)。其中在FPGA軟件設(shè)計中利用模塊化的思想方法分別設(shè)計了FIR濾波器、異步FIFO、UART、電池監(jiān)控、功能控制等
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基于FPGA的異步串行總線設(shè)計

  • 摘要：高速異步串行總線在現(xiàn)代通信設(shè)備中應(yīng)用越來越廣，文中介紹了一種基于FPGA的高速異步串行總線設(shè)計，詳細描述了硬件設(shè)計和總線協(xié)議的實現(xiàn)方法。在現(xiàn)代通信系統(tǒng)的應(yīng)用中有較高的實用價值。
    關(guān)鍵詞：異步串口；FP
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一種通用的FPGA位元電路

  • 摘要：針對目前不同類型FPGA要求的位元電路不一致現(xiàn)象，提出了一種通用的FPGA位元電路，該位元電路不僅適用于任意結(jié)構(gòu)的反熔絲／熔絲FPGA，還可以單獨的存儲1和0，對反熔絲／熔絲熔通后的電阻特性也沒有具體要求。
  • 關(guān)鍵字： FPGA  電路    

基于FPGA的LED點陣顯示字符設(shè)計

  • 隨著社會的發(fā)展和信息時代對各類信息快速發(fā)布的需要，許多政府部門和企事業(yè)單位從提高自身形象和信息規(guī)范化...
  • 關(guān)鍵字： FPGA  LED  點陣顯示  

基于電阻觸摸屏和CPLD來實現(xiàn)多點觸摸系統(tǒng)

  • 　觸摸屏是成熟的技術(shù)，最基本、也是最常用的是4/5線電阻觸摸屏。很多標(biāo)準(zhǔn)屏支持多種尺寸，可以選擇多種解碼模擬解決方案。電阻觸摸屏支持多種輸入方法，比如手指、觸摸筆、手套和指甲等等。電容觸摸屏是一種新的解決
  • 關(guān)鍵字： 觸摸  系統(tǒng)  實現(xiàn)  CPLD  電阻  觸摸屏  基于  

采用CPLD的水下沖擊波記錄儀的應(yīng)用設(shè)計

  • 采用CPLD的水下沖擊波記錄儀的應(yīng)用設(shè)計,1.引言
    　　
    隨著大規(guī)模集成電路和單片機的迅速發(fā)展，復(fù)雜可編程邏輯器件（CPLD）具有使用靈活、可靠性高、功能強大的優(yōu)點，在電子產(chǎn)品設(shè)計中得到了廣泛的應(yīng)用。CPLD可實現(xiàn)在系統(tǒng)編程，重復(fù)多次，而且還兼容IEEE1
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CCD系統(tǒng)下基于FPGA的PCI圖像采集卡設(shè)計與實現(xiàn)

  • 摘要：文章設(shè)計了一種基于FPGA的CCD圖像數(shù)據(jù)采集卡。以FPGA作為圖像數(shù)據(jù)采集卡的核心，通過LVDS傳輸技術(shù)，異步FIFO，異步塊RAM，SRAM緩存乒乓操作等技術(shù)，在PCI核的基礎(chǔ)上實現(xiàn)了Initiator下的DMA傳輸；并基于VxWorks
  • 關(guān)鍵字： FPGA  CCD  PCI  系統(tǒng)    

Vivado震撼來襲 FPGA進入全面可編程時代

  • 　　4年數(shù)百名研發(fā)工程師的夜以繼日，1年100多家客戶和聯(lián)盟計劃成員的親身測試，4月25日，在外界毫無征兆的情況下，賽靈思(Xilinx)公司宣布推出全新的Vivado設(shè)計套件。Xilinx全球高級副總裁湯立人表示，Vivado不是已有15年歷史的ISE設(shè)計套件的再升級(ISE采用的是當(dāng)時極富創(chuàng)新性的基于時序的布局布線引擎)，而是利用多維可拓展的數(shù)據(jù)模型建立設(shè)計實現(xiàn)流程，面向未來10年的all Programmable器件開發(fā)，在高集成度設(shè)計時代加速設(shè)計生產(chǎn)力。 　　我們正在進入一個全面的系統(tǒng)級器件時代
  • 關(guān)鍵字： Vivado  FPGA  
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