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基于Nios II軟核的多核處理器系統(tǒng)的設(shè)計與實現(xiàn)

  • 本文設(shè)計了一個基于FPGA解決方案的多核處理器系統(tǒng)，整體上提高了系統(tǒng)性能，解決了單核處理能力提升受到的制約。通過對多核系統(tǒng)體系結(jié)構(gòu)和核間通信技術(shù)的研究，最終實現(xiàn)了一個利用互斥核實現(xiàn)資源共享的雙Nios II軟核處理器系統(tǒng)，并在Altera公司的FPGA開發(fā)板DE2上進行測試，測試結(jié)果表明所設(shè)計的雙核系統(tǒng)能穩(wěn)定運行。
  • 關(guān)鍵字： FPGA  Nios II  雙核  互斥核  RISC  201405  

Altera徹底改變基于FPGA的浮點DSP

  • 　　Altera公司日前宣布在FPGA浮點DSP性能方面實現(xiàn)了變革。Altera是第一家在FPGA中集成硬核IEEE?754兼容浮點運算功能的可編程邏輯公司，前所未有的提高了DSP性能、設(shè)計人員的效能和邏輯效率。硬核浮點DSP模塊集成在正在發(fā)售的Altera?20?nm?Arria?10?FPGA和SoC中，也集成在14?nm?Stratix?10?FPGA和SoC中。集成硬核浮點DSP模塊結(jié)合先進的高級工
  • 關(guān)鍵字： Altera  FPGA  DSP  

Altera與臺積用先進技術(shù)打造Arria 10 FPGA與SoC

  • 　　Altera公司與臺積公司今日共同宣布雙方攜手合作采用臺積公司擁有專利的細間距銅凸塊封裝技術(shù)為Altera公司打造20?nm?Arria??10?FPGA與?SoC，Altera公司成為首家采用此先進封裝技術(shù)進行量產(chǎn)的公司，成功提升其20?nm器件系列的質(zhì)量、可靠性和效能?！　ltera公司全球營運及工程副總裁Bill?Mazotti表示：「臺積公司提供了一項非常先進且高度整合的封裝解決方案來支持我們的Arria?10&
  • 關(guān)鍵字： SoC  FPGA  Altera  臺積  

Altera公司與臺積公司攜手合作采用先進封裝技術(shù)打造Arria 10 FPGA與 SoC

  • 　　Altera公司?(Nasdaq:?ALTR)?與臺積公司今日共同宣布雙方攜手合作采用臺積公司擁有專利的細間距銅凸塊封裝技術(shù)為Altera公司打造20?nm?Arria??10?FPGA與?SoC，Altera公司成為首家采用此先進封裝技術(shù)進行量產(chǎn)的公司，成功提升其20?nm器件系列的質(zhì)量、可靠性和效能?！　ltera公司全球營運及工程副總裁Bill?Mazotti表示：「臺積公司提供了一項非常先進且
  • 關(guān)鍵字： SoC  FPGA  Altera  

一種基于FPGA的多通道高速采樣系統(tǒng)設(shè)計

  • 摘要：旋轉(zhuǎn)機械的振動監(jiān)測，對于機械的安全運行和提高設(shè)備利用率有重大意義。利用FPGA的并行處理能力，采用高速可編程FPGA模塊和嵌入式開發(fā)的結(jié)合方式，提出了一種基于FPGA的高速、多通道、同步采樣實現(xiàn)方法。闡述了對于高速AD芯片的控制，硬件的布局布線，以及對于系統(tǒng)的功能要求，進行了軟硬件的設(shè)計和調(diào)試。通過仿真和實驗的結(jié)果表明，對于信號發(fā)生器發(fā)出的高頻率正弦波，上位機上能夠顯示出完好的波形，即基于FPGA的采樣設(shè)計能夠達到多通道，高速采樣的要求，可以實現(xiàn)對高速旋轉(zhuǎn)機械振動的實時監(jiān)測。 0 引言 大型旋轉(zhuǎn)
  • 關(guān)鍵字： FPGA  EP3C25Q240  

超聲波瓶體厚度檢測及其材料分類的研究，保障公共安全

  • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
  • 關(guān)鍵字： 超聲波  瓶體厚度檢測  FPGA  人工神經(jīng)網(wǎng)絡(luò)算法  

基于FPGA的行人檢測系統(tǒng)設(shè)計，實現(xiàn)智能視頻監(jiān)控

  • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
  • 關(guān)鍵字： FPGA  行人檢測  背景建模  多尺度檢測  Adaboost算法  

基于ARM+FPGA的視頻采集處理系統(tǒng)設(shè)計

  • 摘要：設(shè)計了一種可進行實時視頻采集、壓縮和傳輸?shù)囊曨l采集處理系統(tǒng)。該系統(tǒng)充分結(jié)合FPGA和ARM的硬件優(yōu)勢，實現(xiàn)了設(shè)備接口和視頻信號處理的全數(shù)字化，易與信號處理新技術(shù)相結(jié)合，系統(tǒng)結(jié)構(gòu)緊湊，體積小巧、響應(yīng)快速;基于FPGA的前端處理更增加了圖像處理算法升級的靈活性，適用于工業(yè)遠程監(jiān)控等多種場合。 關(guān)鍵詞：圖像傳感器;FPGA;視頻壓縮;ARM;以太網(wǎng) Abstract: To collect data in high speed and be simple in the structure, a Vid
  • 關(guān)鍵字： ARM  FPGA  

測量軟件引領(lǐng)射頻與通信行業(yè)變革

  • 　　美國國家儀器公司?(National?Instruments,?簡稱?NI)作為企業(yè)贊助商參加于2014年4月8日至10日在北京國際會議中心舉辦的第二屆電子設(shè)計創(chuàng)新會議(EDI?CON)。NI在此次會議上向與會嘉賓展示了其基于LabVIEW?RIO架構(gòu)的新一代矢量信號收發(fā)儀，掀起了軟件引領(lǐng)射頻與通信行業(yè)進行變革的浪潮?！　∫蛔哌M北京國際會議中心位于一樓的EDI?CON展廳，迎面就可以看到NI與其子公司AWR的54平米聯(lián)合展位。NI向
  • 關(guān)鍵字： NI  EDI  FPGA  MIMO  

基于FPGA和AD1836的I2S接口設(shè)計與實現(xiàn)

  • 引 言 AD1836是ADI公司新推出的一款高性能的單片聲碼器，適用于數(shù)字音頻系統(tǒng)。它采用5V供電，數(shù)字接口輸入輸出電平為LVTTL電平，可以直接和一般的FPGA連接。 AD1836集成了3路立體的D/A和兩路立體的A/D，參考電壓為2.25V，為了降低信號的干擾，模擬信號的輸入輸出均采用差分的形式，輸入輸出模擬信號的最大峰峰值為5.6V。系統(tǒng)時鐘為12.288MHz，數(shù)據(jù)采樣率最高為96kHz，采樣位數(shù)最高為24位，可以通過SPI口方便地對內(nèi)部功能寄存器進行配置，從而選擇相應(yīng)的功能，例如：時鐘、工作
  • 關(guān)鍵字： FPGA  AD1836  

萊迪思適用于小型蜂窩網(wǎng)絡(luò)、微型服務(wù)器、寬帶接入的ECP5 FPGA產(chǎn)品系列

  • 　　萊迪思半導(dǎo)體公司日前宣布推出ECP5?產(chǎn)品系列，面向?qū)τ跇O低成本、極低功耗、極小尺寸有著苛刻要求的小型蜂窩網(wǎng)絡(luò)、微型服務(wù)器、寬帶接入、工業(yè)視頻等大批量應(yīng)用。ECP5產(chǎn)品系列“打破陳規(guī)”，提供基于SERDES的解決方案，幫助設(shè)計者快速添加功能和特性輔助ASIC和ASSP設(shè)計，降低開發(fā)風(fēng)險，迅速克服產(chǎn)品上市時間帶來的挑戰(zhàn)?！　∪R迪思優(yōu)化了ECP5系列產(chǎn)品架構(gòu)，從而使得使低于100K?LUT的器件能夠?qū)崿F(xiàn)其最大的價值，作為ASIC和ASSP的輔助芯片完成關(guān)鍵功能。相比競爭對手的解決方案，我們的成本
  • 關(guān)鍵字： 萊迪思  ECP5  TRIAX  FPGA  

基于DSP+FPGA的通用SSR信號處理機設(shè)計

  • 0 引言 二次雷達(Secondary Surveillance Radar,SSR)目標識別系統(tǒng)能夠通過發(fā)射特定的射頻脈沖序列對裝有應(yīng)答機的目標進行“一問一答”式的詢問，由應(yīng)答機的應(yīng)答脈沖碼獲得目標的高度、編號等信息。航管二次雷達常用的基本工作模式為傳統(tǒng)的A/C模式和新近的S模式。 A模式提供飛機的代碼，C模式提供飛機的高度碼。但是，傳統(tǒng)的A/C 模式存在一些技術(shù)缺陷，如多目標代碼交織、重疊、多徑反射，同步竄擾，異步干擾等。這在大型航空港等飛機非常密集的地方，時間不同步和混淆
  • 關(guān)鍵字： DSP  FPGA  

全面解析Nios Ⅱ嵌入式軟核多處理器系統(tǒng)

  • 通過對硬件互斥核，程序存儲器分區(qū)，重疊地址空間，啟動地址和異常地址的分析，提出了多處理器系統(tǒng)共享片上存儲器、FLASH存儲器和外設(shè)資源的解決方法，為Nios Ⅱ嵌入式多處理器系統(tǒng)的設(shè)計提供了有效的方法和途徑。 0 引言 基于SoPC 技術(shù)開發(fā)的嵌入式Nios Ⅱ軟核多處理器系統(tǒng)具有可自主設(shè)計，重構(gòu)性好，軟硬件裁剪容易，系統(tǒng)擴充升級方便，能兼顧性能、體積、功耗、成本、可靠性等方面的要求。研發(fā)嵌入式Nios Ⅱ軟核多處理器系統(tǒng)，是提高嵌入式系統(tǒng)性價比和實用性一種有效途徑。 1 片上Nios Ⅱ嵌入式軟核
  • 關(guān)鍵字： SoPC   Nios Ⅱ  

便于FPGA市場現(xiàn)狀和發(fā)展前景展望

  • 通常來說半導(dǎo)體產(chǎn)業(yè)是周期性行業(yè)，其周期一般為4到5年。但是隨著新技術(shù)和應(yīng)用的快速發(fā)展，現(xiàn)今半導(dǎo)體周期越來越短，且每一個周期都有典型應(yīng)用作為拉動點，比如過去的PC、后來的通信行業(yè)。FPGA也明顯符合這種規(guī)律。但不同的是，當ASIC和ASSP蕭條的時候，往往迎來FPGA的大發(fā)展。2008年以來的金融危機使得半導(dǎo)體行業(yè)平均跌幅大于10%，但是市場數(shù)據(jù)卻顯示FPGA行業(yè)依然強勁增長。危機和低迷使ASIC和ASSP制造者為謹慎起見，不敢貿(mào)然推出新產(chǎn)品，避免巨大的NRE費用。而FPGA恰好能迎合這一需求。全球FPGA
  • 關(guān)鍵字： FPGA  ASIC  ASSP  

Altera：FPGA服務(wù)持續(xù)升級

  • Altera公司是可編程邏輯解決方案的倡導(dǎo)者，為全球客戶提供非常有價值的可編程解決方案。 Altera致力于28nm FPGA的全線生產(chǎn)，2012年28nm的FPGA產(chǎn)品，包括高端的Stratix、中端的Arria、低端的Cyclone都已經(jīng)進入量產(chǎn)和發(fā)貨階段，而且從試產(chǎn)到量產(chǎn)的階段是有史以來最快的。Altera 2012年在28nm方面的重要里程碑包括：3月，開始交付業(yè)界第一款高性能28nm Stratix V FPGA，率先在眾多的應(yīng)用中實現(xiàn)了創(chuàng)新，其中包括28Gb/s收發(fā)器、精度可調(diào)DSP模塊、PC
  • 關(guān)鍵字： Altera  FPGA  ARM  
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