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基于FPGA的脈沖重復(fù)頻率(PRF)跟蹤器的設(shè)計
- 本文利用FPGA資源豐富?易于編程的特點設(shè)計了純硬方式的脈沖重復(fù)頻率跟蹤器,實現(xiàn)了在密集信號環(huán)境下的信號跟蹤,并且將多路并行的跟蹤器集成在一片F(xiàn)PGA中,簡化了系統(tǒng)結(jié)構(gòu),縮小了體積?
- 關(guān)鍵字: 多路脈沖重復(fù)頻率跟蹤器 關(guān)聯(lián)比較器 FPGA
IIR數(shù)字濾波器的FPGA仿真與實現(xiàn)
- 采用自頂向下的模塊化設(shè)計思想,介紹了一種采用級聯(lián)結(jié)構(gòu)在FPGA上實現(xiàn)IIR數(shù)字濾波器的設(shè)計方案。設(shè)計IIR數(shù)字濾波器的二階節(jié),將二階節(jié)IIR數(shù)字濾波器級聯(lián)實現(xiàn)高階IIR數(shù)字濾波器,從而實現(xiàn)通過修改外圍參數(shù)來改變?yōu)V波器的頻率響應(yīng),根據(jù)不同的要求在不同規(guī)模的FPGA上加以實現(xiàn)。
- 關(guān)鍵字: IIR數(shù)字濾波器 級聯(lián)結(jié)構(gòu) FPGA
FPGA在航空電子系統(tǒng)中的設(shè)計應(yīng)用
- 由于競爭的壓力和對飛機性能無止境的追求,航空電子從簡單、獨立的設(shè)備發(fā)展到如今以每秒百萬位乃至更快的速度交換信息的高級智能系統(tǒng)網(wǎng)絡(luò)。這也帶來了必須克服的許多設(shè)計問題。
- 關(guān)鍵字: 高級智能系統(tǒng)網(wǎng)絡(luò) 航空電子 FPGA
數(shù)字圖像倍焦系統(tǒng)設(shè)計與實現(xiàn)綜合實例之:系統(tǒng)硬件配置方案
- FPGA作可編程器件,可以根據(jù)用戶的需要進行現(xiàn)場可編程。系統(tǒng)可采用了JTAG模式和AS模式進行FPGA編程配置。
- 關(guān)鍵字: 數(shù)字圖像倍焦系統(tǒng) JTAG FPGA EPC1441PC8
數(shù)字圖像倍焦系統(tǒng)設(shè)計與實現(xiàn)綜合實例之:系統(tǒng)原理框圖
- 本系統(tǒng)采用了兩片SRAM存儲器構(gòu)成乒乓緩沖結(jié)構(gòu)來完成視頻的采集和處理,視頻的采集和輸出部分采用了應(yīng)用廣泛的SAA71XX系列。
- 關(guān)鍵字: 數(shù)字圖像倍焦系統(tǒng) SRAM存儲器 乒乓緩沖 FPGA
數(shù)字圖像倍焦系統(tǒng)設(shè)計與實現(xiàn)綜合實例之:系統(tǒng)工作原理分析
- 如前所述,本系統(tǒng)主要完成對輸入視頻圖像的兩倍放大。圖像的放大主要是通過插值算法來實現(xiàn)的,下面詳細分析如何應(yīng)用雙線性插值算法來實現(xiàn)倍焦功能。
- 關(guān)鍵字: 數(shù)字圖像倍焦系統(tǒng) 乘法器 FPGA
有限狀態(tài)機的FPGA設(shè)計
- 有限狀態(tài)機是一種常見的電路,由于時序電路和組合電路組成,設(shè)計有限狀態(tài)機的第一步是確定采用Moore狀態(tài)機還是采用Mealy狀態(tài)機。Mealy狀態(tài)機的狀態(tài)轉(zhuǎn)變不僅和當(dāng)前狀態(tài)有關(guān),而且和各輸入信號有關(guān);Moore狀態(tài)機的轉(zhuǎn)變只和當(dāng)前狀態(tài)有關(guān)。從電路實現(xiàn)功能上來講,任何一種都可以實現(xiàn)同樣的功能。但他們的輸出時序不同,所以選擇使用哪種狀態(tài)機是要根據(jù)具體情況來定。
- 關(guān)鍵字: Moore狀態(tài)機 Mealy狀態(tài)機 FPGA
數(shù)字圖像倍焦系統(tǒng)設(shè)計與實現(xiàn)綜合實例之:設(shè)計需求分析與芯片選型
- 在數(shù)字圖像處理和通信、遙感圖像分析、醫(yī)學(xué)成像診斷等應(yīng)用領(lǐng)域,為了便于顯示、觀察或進行進一步的處理,常常需要對原始的數(shù)字圖像進行特征提取(如邊緣檢測、邊緣銳化)、噪聲平滑濾波、幾何校正、尺寸縮放等處理,這類圖像處理技術(shù)稱為圖像的預(yù)處理。在實際應(yīng)用中,圖像的預(yù)處理功能很多可以通過FPGA來實現(xiàn)。
- 關(guān)鍵字: 數(shù)字圖像倍焦系統(tǒng) 視頻解碼器 FPGA 視頻編碼器 乒乓緩沖區(qū)
H.264/AVC中CAVLC編碼器的硬件設(shè)計與實現(xiàn)
- 設(shè)計了一種H.264標(biāo)準(zhǔn)的CAVLC編碼器,對原有軟件流程進行部分改進,提出了并行處理各編碼子模塊的算法結(jié)構(gòu)。
- 關(guān)鍵字: 變長編碼 非零系數(shù)級編碼 FPGA
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