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基于FPGA的系統(tǒng)易測試性的研究

  • 基于FPGA的系統(tǒng)易測試性的研究,引 言
    　　現(xiàn)代科技對系統(tǒng)的可靠性提出了更高的要求，而FPGA技術(shù)在電子系統(tǒng)中應(yīng)用已經(jīng)非常廣泛，因此FPGA易測試性就變得很重要。要獲得的FPGA內(nèi)部信號十分有限、FPGA封裝和印刷電路板(PCB)電氣噪聲，這一切使得設(shè)計(jì)
  • 關(guān)鍵字： 研究  測試  系統(tǒng)  FPGA  基于  

利用視覺系統(tǒng)來防止PCB缺陷的產(chǎn)生

  • 1、前言　　在現(xiàn)代電子產(chǎn)品世界中，PCB(印刷電路板)是組成電子產(chǎn)品的重要環(huán)節(jié)，很難想象在一臺電子設(shè)備中有不采用PCB的，所以PCB的質(zhì)量如何將對電子產(chǎn)品能否長期正?？煽抗ぷ鲙矸浅４蟮挠绊?。提高 PCB的質(zhì)量是電子
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基于FPGA的串口屏方案應(yīng)用

  • 本文主要介紹一個基于串口屏、M0單片機(jī)、微打模塊、讀卡模塊的充電樁應(yīng)用方案。此方案模擬了真實(shí)充電樁的絕大部分功能，通過使用本方案，設(shè)備制造商便能在短周期內(nèi)完成整個充電樁的設(shè)計(jì)，迅速占領(lǐng)市場并取得成功。
  • 關(guān)鍵字： FPGA  單片機(jī)  TinyM0-CAN  201109  

使用Xilinx公司的Spartan-6 FPGA作DDR芯片測試

  • 使用Xilinx公司的Spartan-6 FPGA系列芯片所提供的MCB，在生成控制模塊時(shí)設(shè)置不同參數(shù)，可以輕而易舉的實(shí)現(xiàn)對不同型號的DDR存儲芯片的測試，數(shù)據(jù)率可高達(dá)800Mb/s以上。由于時(shí)間利用率比使用計(jì)算機(jī)主板測試DDR芯片高得多，所以可以極大地節(jié)約測試時(shí)間。
  • 關(guān)鍵字： Xilinx  FPGA  DDR  201109  

Altera推出業(yè)界第一款Serial RapidIO Gen2解決方案

  • 2011年9月27號，北京——Altera公司 (NASDAQ: ALTR) 今天宣布，開始提供業(yè)界第一款基于Serial RapidIO Gen2 FPGA的解決方案，進(jìn)一步提高下一代3G和4G無線基站的帶寬，鏈路更加靈活。Altera成功的實(shí)現(xiàn)了Stratix IV GX FPGA中的RapidIO MegaCore 功能IP內(nèi)核與集成器件技術(shù)公司 (IDT) Serial RapidIO Gen 2交換機(jī)的互操作性。Altera成熟的Serial RapidIO Gen2解決方案為高性能通信系統(tǒng)中
  • 關(guān)鍵字： Altera  FPGA  

基于FPGA的信號發(fā)生器設(shè)計(jì)

  • 基于FPGA的信號發(fā)生器設(shè)計(jì),以FPGA 芯片為載體， 通過QuartusII 的LPM_ROM 模塊和VHDL 語言為核心設(shè)計(jì)一個多功能信號發(fā)生器，根據(jù)輸入信號的選擇可以輸出遞增鋸齒波、遞減鋸齒波、三角波、階梯波和方波等5 種信號，通過QuartusII 軟件進(jìn)行波形仿
  • 關(guān)鍵字： 設(shè)計(jì)  信號發(fā)生器  FPGA  基于  

LabVIEW FPGA模塊實(shí)現(xiàn)FIFO深度設(shè)定

  • 為了解決基于LabVIEWFPGA模塊的DMAFIFO深度設(shè)定不當(dāng)帶來的數(shù)據(jù)不連續(xù)問題，結(jié)合LabVIEWFPGA的編程特點(diǎn)和DMA FIFO的工作原理，提出了一種設(shè)定FIFO深度的方法。對FIFO不同深度的實(shí)驗(yàn)表明，采用該方法設(shè)定的FIFO深度能夠
  • 關(guān)鍵字： LabVIEW  FPGA  FIFO  模塊    

FPGA與GPS_OEM板的UART設(shè)計(jì)

  • 本文提出了一種基于FPGA的嵌入式UART模塊化設(shè)計(jì)方法，通過UART實(shí)現(xiàn)了FPGA與GPS_OEM板之間的數(shù)據(jù)通信。基于VHDL語言，通過有限狀態(tài)機(jī)，將UART模塊集成到FPGA上，給出了系統(tǒng)的功能仿真結(jié)果，驗(yàn)證了系統(tǒng)設(shè)計(jì)的正確性，增強(qiáng)了設(shè)計(jì)的靈活性。
  • 關(guān)鍵字： FPGA  UART  201109  

基于MCU+FPGA的航空總線接口板測試平臺設(shè)計(jì)

  • 設(shè)計(jì)的航空總線接口板測試平臺滿足通用設(shè)備CAN總線、RS485差分電平異步總線及LVDS差分電平異步總線數(shù)據(jù)傳輸要求。通過對各模塊功能分析，在仿真軟件中通過功能仿真驗(yàn)證，并在工程應(yīng)用中得到驗(yàn)證。此設(shè)計(jì)通過RS232接口連接上位機(jī)實(shí)現(xiàn)數(shù)據(jù)收發(fā)，并能對CAN總線及高速異步總線參數(shù)進(jìn)行動態(tài)配置。
  • 關(guān)鍵字： CAN  FPGA  MCU  201109  

SDRAM接口時(shí)序和PCB布線長度的分析

  • 隨著系統(tǒng)復(fù)雜度的提高，SDRAM的運(yùn)行速度也越來越快，對PCB布線帶來了影響，僅僅使用一些經(jīng)驗(yàn)法則來設(shè)計(jì)SDRAM走線并不能完全保證系統(tǒng)的穩(wěn)定。不同的芯片有不同的時(shí)序要求，對走線的要求也是有差別，需要從理論上分析SDRAM時(shí)序和PCB走線長度之間的關(guān)系。
  • 關(guān)鍵字： SDRAM  PCB  201109  

LEON2應(yīng)用于DCPU的FPGA仿真

  • LEON2應(yīng)用于DCPU的FPGA仿真,近年來，隨著數(shù)字多媒體業(yè)務(wù)和Internet網(wǎng)絡(luò)的迅速發(fā)展，新型數(shù)字機(jī)頂盒可以有效利用我國巨大的有線電視網(wǎng)絡(luò)資源，完成視頻點(diǎn)播、數(shù)字電視的接收及接入Internet等綜合業(yè)務(wù)功能?！?br />
    1 數(shù)字機(jī)頂盒總體設(shè)計(jì)方案　
  • 關(guān)鍵字： 仿真  FPGA  DCPU  應(yīng)用  LEON2  

FPGA低功耗設(shè)計(jì)的小提示

  • FPGA的功耗高度依賴于用戶的設(shè)計(jì)，沒有哪種單一的方法能夠?qū)崿F(xiàn)這種功耗的降低，如同其它多數(shù)事物一樣，降低功耗的...
  • 關(guān)鍵字： 低功耗  FPGA  

基于FPGA原型設(shè)計(jì) 能為您做些什么？

  • 作為基于FPGA原型方法的擁護(hù)者，有人可能會認(rèn)為我們只片面地看到了這種方法的優(yōu)點(diǎn)，而對其缺陷視而不見。但那...
  • 關(guān)鍵字： FPGA  原型設(shè)計(jì)  

DSP和FPGA構(gòu)成的感應(yīng)發(fā)電機(jī)勵磁控制系統(tǒng)

利用FPGA的DSP功能提高圖像處理的實(shí)例

  • intevac是商用和軍用市場光學(xué)產(chǎn)品的前沿開發(fā)商。本文介紹該公司nightvista嵌入式電子系統(tǒng)的開發(fā)，該產(chǎn)品是高...
  • 關(guān)鍵字： 可配置軟核處理器  FPGA  DSP  
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