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一種混合結(jié)構(gòu)高速LDPC編碼器的FPGA實現(xiàn)
- 分析了準循環(huán)低密度奇偶校驗碼生成矩陣的結(jié)構(gòu)特點,討論了硬件可實現(xiàn)的三種常見編碼器結(jié)構(gòu),提出了一種混合結(jié)構(gòu)的FPGA實現(xiàn)方法。通過利用循環(huán)矩陣的結(jié)構(gòu)特性,增加少量硬件開銷,就可以實現(xiàn)編碼器高速編碼,滿足高速通信需求,吞吐量達1.36Gb/s。
- 關(guān)鍵字: 奇偶校驗碼 循環(huán)矩陣 FPGA
SRAM型FPGA單粒子效應(yīng)試驗研究
- 針對軍品級SRAM型FPGA的單粒子效應(yīng)特性,文中采用重離子加速設(shè)備,對Xilinx公司Virtex-II系列可重復(fù)編程FPGA中一百萬門的XQ2V1000進行輻射試驗。試驗中,被測FPGA單粒子翻轉(zhuǎn)采用了靜態(tài)與動態(tài)兩種測試方式。并且通過單粒子功能中斷的測試,研究了基于重配置的單粒子效應(yīng)減緩方法。試驗發(fā)現(xiàn)被測FPGA對單粒子翻轉(zhuǎn)與功能中斷都較為敏感,但是在注入粒子LET值達到42MeV.cm2/mg時仍然對單粒子鎖定免疫。
- 關(guān)鍵字: 單粒子效應(yīng) 重離子加速設(shè)備 FPGA
基于FPGA的平方根升余弦濾波器設(shè)計
- 為了滿足陸上集群無線電(TETRA)數(shù)字集群系統(tǒng)對基帶信號成形處理的要求,提出了一種用于TETRA數(shù)字集群系統(tǒng)的平方根升余弦(SRRC)濾波器設(shè)計,論述了基帶成形濾波和SRRC濾波器的基本原理,分析了窄帶調(diào)制帶寬限制、TETRA鄰道干擾限制和濾波器階數(shù)等需解決的問題,論述了濾波器參數(shù)設(shè)計和FIR濾波器FPGA實現(xiàn)等關(guān)鍵技術(shù),完成了對基于FPGA的SRRC濾波器設(shè)計的仿真分析。
- 關(guān)鍵字: 數(shù)字集群系統(tǒng) 基帶信號 FPGA
基于FPGA圖形字符加速的液晶顯示模塊
- 在傳統(tǒng)的工業(yè)控制應(yīng)用中,由于工業(yè)控制計算機中集成了高性能的顯卡,故通常采用工業(yè)控制計算機+液晶顯示器的體系結(jié)構(gòu),可方便地實現(xiàn)以圖形和字符為主的人機界面。而在對實時性能和可靠性要求比較高的航空航天領(lǐng)域,通常要求液晶顯示器內(nèi)部集成圖形顯示功能,以減輕主控處理器的負擔,并提高系統(tǒng)的實時性。重點介紹了如何利用FPGA實現(xiàn)基于Bresenham算法的2D圖形繪制(包括畫點、畫線、畫圓、畫橢圓),以及點陣字符和位圖在液晶屏上的顯示,并提出了顯示性能優(yōu)化的一系列策略。
- 關(guān)鍵字: 圖形顯示 2D圖形繪制 FPGA
基于FPGA的高精度時間數(shù)字轉(zhuǎn)換電路的設(shè)計與實現(xiàn)
- 本文介紹一種基于 FPGA高精度時間數(shù)字轉(zhuǎn)換電路的設(shè)計方法,利用片內(nèi)鎖相環(huán)(PLL)和環(huán)形移位寄存器,采用不高的系統(tǒng)時鐘便可得到很高的時間分辨率,且占用較少邏輯資源??勺鳛楣δ茈娐藩毩⑹褂?,也可作為 IP核方便地移植到其他片上系統(tǒng)(SOC)中。在 Altera公司的 Stratix和 Cyclone系列芯片上實現(xiàn)時,時間分辨率昀高可達 3.3ns。時序仿真和硬件測試表明該方法的可行性和準確性。
- 關(guān)鍵字: 時間數(shù)字轉(zhuǎn)換電路 激光探測 FPGA
量程自整定高精度頻率測量的FPGA實現(xiàn)
- 數(shù)字頻率計是一種應(yīng)用十分廣泛的電子測量儀表,針對寬頻率范圍被測信號頻率測量應(yīng)用需求,提出并實現(xiàn)了一種基于FPGA的自動量程切換高精度數(shù)字頻率計的設(shè)計方法。通過構(gòu)建測頻控制器、閘門同步生成器、量程自動切換等模塊,并采用Verilog HDL語言進行描述,運用自頂向下的數(shù)字系統(tǒng)設(shè)計方法實現(xiàn)了寬頻率范圍頻率測量的量程自動切換。在Xilinx公司的XUPV5-LX110T開發(fā)板上進行了測試,給出了系統(tǒng)后仿真波形。結(jié)果表明目標系統(tǒng)能根據(jù)被測信號頻率范圍進行自動量程切換,實現(xiàn)高精度頻率測量,測量精度不低于10-7,
- 關(guān)鍵字: 數(shù)字頻率計 自動量程切換 FPGA
基于FPGA的電子攝像系統(tǒng)的穩(wěn)像設(shè)計
- 穩(wěn)像系統(tǒng)的反應(yīng)速度是電子穩(wěn)像要解決的關(guān)鍵技術(shù)之一。傳統(tǒng)的基于“攝像機-圖像采集卡-計算機”模式的穩(wěn)像系統(tǒng)、圖像檢測和匹配算法全部由計算機以軟件方式實現(xiàn)。盡管當今計算機的性能很高,能夠部分滿足單傳感器電子穩(wěn)系統(tǒng)的實時處理要求,但在以下幾個方面有著難以解決的問題:首先,其固有的串行工作方式使得單計算機難以適應(yīng)其于多傳感器視頻處理系統(tǒng)的實時穩(wěn)像,阻礙了在實際中的應(yīng)用adw欠,傳統(tǒng)的圖像采集卡中能將采集圖像數(shù)據(jù)實時傳輸給計算機,而不能傳輸給標準接口的視頻監(jiān)視設(shè)備lk之很多應(yīng)用場合對聽要求很高。因此,研制專用的電
- 關(guān)鍵字: 隔行掃描 電子穩(wěn)像系統(tǒng) FPGA
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