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音樂播放控制電路設(shè)計(jì)方案

  • 隨著電子技術(shù)發(fā)展，電子電路的形式趨向復(fù)雜化，面對(duì)這一狀況，人們已經(jīng)清醒地認(rèn)識(shí)到，要分析和設(shè)計(jì)復(fù)雜的電子系統(tǒng)人...
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基于FPGA的智能儀器遠(yuǎn)程控制系統(tǒng)

  • 摘要：為實(shí)現(xiàn)智能儀器的遠(yuǎn)程控制，提高控制系統(tǒng)的速度，采用現(xiàn)場(chǎng)可編程門陣列(FPGA)芯片、USB芯片等實(shí)現(xiàn)了智能儀...
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基于FPGA的軟件無線電可編程DDC的設(shè)計(jì)

  • 0引言近年來，軟件無線電已經(jīng)成為通信領(lǐng)域一個(gè)新的發(fā)展方向，數(shù)字下變頻技術(shù)(DIGItalDownCONverter-DDC...
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基于FPGA的變頻器慣性輸出技術(shù)

  • 1引言節(jié)能降耗是國(guó)家的基本國(guó)策，而電廠節(jié)能是電力系統(tǒng)節(jié)能降耗的重要環(huán)節(jié)，采用高壓變頻技術(shù)對(duì)電廠重要...
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如何保護(hù)FPGA輸入端的齊納二極管

  • 雖然5V電源邏輯在很多應(yīng)用中仍很常見，但大多數(shù)FPGA都支持3.3V以及更低的接口電平。FPGA應(yīng)用說明通常建議，當(dāng)把...
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圖像的二維提升小波變換的FPGA實(shí)現(xiàn)

  • 圖像的二維提升小波變換的FPGA實(shí)現(xiàn),小波分析理論以其良好的時(shí)頻區(qū)域性和多分辨率分析能力，開辟了圖像處理的嶄新領(lǐng)域。小波變換是一種很好的圖像分解方法，非常適合于分析突變信號(hào)而用于靜止圖像邊緣的提取和壓縮。高階小波變化還可以用于實(shí)時(shí)處理視頻
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FPGA幫您實(shí)現(xiàn)家居遙控

  • 　引言　　人們生活中的家用電器種類日益增多，遙控器的種類也隨之增加，不同種類的遙控器之間一般不能相互替代，這給人們的生活帶來諸多不便?！　「黝愡b控器功能大致相同，大多都有數(shù)字鍵、啟動(dòng)停止鍵、前進(jìn)鍵、快
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基于FPGA的紅外遙控信號(hào)接收模塊的設(shè)計(jì)

  • 摘要：文中分析了紅外線遙控器系統(tǒng)的數(shù)據(jù)編碼和傳輸機(jī)制，并用VerilogHDL語言設(shè)計(jì)了基于FPGA的紅外接收模塊硬件電路，在VCS和VirSim仿真工具中進(jìn)行了仿真測(cè)試；用XilinxISE 10．1軟件進(jìn)行了綜合、適配和FPGA器件下栽
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基于CPLD系統(tǒng)的信號(hào)發(fā)生器設(shè)計(jì)

  • 摘要：文中采用Quartus II開發(fā)平臺(tái)，基于可編程邏輯器件CPLD設(shè)計(jì)出多波形信號(hào)發(fā)生器，可輸出頻率、幅度可調(diào)的三角波、正弦波和方波。任意波形模塊可由用戶輸出用戶所需的特殊波形，滿足了教學(xué)實(shí)驗(yàn)和開發(fā)新的實(shí)驗(yàn)項(xiàng)目
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IIS接口的FPGA實(shí)現(xiàn)

  • IIS接口的FPGA實(shí)現(xiàn),在嵌入式系統(tǒng)中經(jīng)常采用IIS(Inter-IC Sound)總線連接專用音頻器件以實(shí)現(xiàn)音頻輸入輸出。不少嵌入式處理器帶有專用的通過操作特殊功能寄存器實(shí)現(xiàn)對(duì)外接音頻器件的操作，但也有一些嵌入式處理器沒有擴(kuò)展IIS總線，如ARM7
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基于USB通信的FPGA高速數(shù)據(jù)采集系統(tǒng)

  • 摘要：為了解決高速數(shù)據(jù)采集以及數(shù)據(jù)傳輸問題，設(shè)計(jì)了基于USB通信的FPGA高速數(shù)據(jù)采集系統(tǒng)。方案以FPGA為控制核心，實(shí)現(xiàn)A／D控制、數(shù)據(jù)緩存雙口RAM和控制CY7C68013A三個(gè)功能。系統(tǒng)采用Verilog HDL語言，通過ISE軟件編
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基于FPGA的線陣CCD驅(qū)動(dòng)設(shè)計(jì)

  • 摘要：電荷耦合器件(CCD)作為一種新型的光電器件，被廣泛地應(yīng)用于非接觸測(cè)量。而CCD驅(qū)動(dòng)設(shè)計(jì)是CCD應(yīng)用的關(guān)鍵問題之一。為了克服早期CCD驅(qū)動(dòng)電路體積大，設(shè)計(jì)周期長(zhǎng)，調(diào)試?yán)щy等缺點(diǎn)，以線陣CCD圖像傳感器TCD1251UD為
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基于CPLD／PPGA的出租車計(jì)費(fèi)系統(tǒng)

  • 介紹了出租車計(jì)費(fèi)器系統(tǒng)的組成及工作原理，簡(jiǎn)述了在EDA平臺(tái)上用單片CPLD器件構(gòu)成該數(shù)字系統(tǒng)的設(shè)計(jì)思想和實(shí)現(xiàn)過程。論述了車型調(diào)整模塊、計(jì)程模塊、計(jì)費(fèi)模塊、譯碼動(dòng)態(tài)掃描模塊等的設(shè)計(jì)方法與技巧。

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線性調(diào)頻信號(hào)基于FPGA IP核的脈沖壓縮設(shè)計(jì)

  • 摘要：為實(shí)現(xiàn)線性調(diào)頻信號(hào)的數(shù)字脈沖壓縮，設(shè)計(jì)一個(gè)FPGA硬件平臺(tái)，并著重提出一種基于FPGA IP核的脈沖壓縮設(shè)計(jì)方法。針對(duì)脈沖壓縮進(jìn)行了理論分析和Matlab仿真，設(shè)計(jì)完成后對(duì)系統(tǒng)軟、硬件進(jìn)行了全面測(cè)試，并根據(jù)實(shí)測(cè)數(shù)
  • 關(guān)鍵字： FPGA  線性調(diào)頻信號(hào)  IP核  脈沖壓縮    

基于FPGA的LCoS驅(qū)動(dòng)和圖像處理系統(tǒng)設(shè)計(jì)

  • 摘要：針對(duì)分辨率為1 024times;768的LCoS屏編寫了Verilog HDL驅(qū)動(dòng)代碼，在quartusⅡ9．1平臺(tái)上綜合編譯，并在Altera的FPGA芯片EP3C5E14 4C8上進(jìn)行了功能驗(yàn)證和實(shí)際輸出信號(hào)測(cè)量。采用異步FIFO結(jié)構(gòu)解決了跨異步時(shí)鐘域
  • 關(guān)鍵字： FPGA  LCoS  驅(qū)動(dòng)  圖像處理    
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