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EEPW首頁 >> 主題列表 >> cpld／fpga

基于FPGA和DSP的微型慣導(dǎo)系統(tǒng)

  • 慣導(dǎo)系統(tǒng)的硬件組成直接影響到系統(tǒng)的體積和解算速度,構(gòu)建合理的硬件系統(tǒng)直接關(guān)系到慣導(dǎo)系統(tǒng)的精度指標(biāo)。針對某小型慣導(dǎo)系統(tǒng)對體積和解算精度的特殊要求,解決已有微型慣導(dǎo)系統(tǒng)的方案缺陷,提出一種工程實用強的慣導(dǎo)系統(tǒng)。該系統(tǒng)用FPGA作為采集控制慣性傳感器的核心芯片,設(shè)計了并行采集方案,32位浮點型高速DSP實現(xiàn)慣導(dǎo)解算。經(jīng)過轉(zhuǎn)臺測試與外場試驗表明:系統(tǒng)具有抗干擾能力強、實時響應(yīng)迅速、慣性單元標(biāo)定簡便、易實現(xiàn)等優(yōu)點,系統(tǒng)指標(biāo)完全滿足原設(shè)計要求。
  • 關(guān)鍵字： 慣導(dǎo)系統(tǒng)  慣性傳感器  FPGA  

基于FPGA的精跟蹤系統(tǒng)

  • 主要研究空間激光通信系統(tǒng)中精跟蹤技術(shù),根據(jù)精跟蹤系統(tǒng)的組成原理與工作原理,設(shè)計了一種輕小型化、智能化精跟蹤系統(tǒng),該系統(tǒng)以FPGA作為核心器件,完成光斑圖像采集、圖像濾波、光斑位置計算、數(shù)字控制補償函數(shù)及脫靶量的實時輸出等功能。同時系統(tǒng)可根據(jù)外部環(huán)境變化,自動調(diào)整相機閾值、開窗口位置、積分時間。搭建試驗系統(tǒng)完成精跟蹤實驗,實驗表明系統(tǒng)可實現(xiàn)脫靶量實時輸出3 000 Hz以上,符合精跟蹤控制系統(tǒng)技術(shù)指標(biāo)要求。系統(tǒng)在像元分辨力為3μrad的情況下,實時跟蹤均方根值為1.17μrad,滿足空間激光通信對精跟蹤的要
  • 關(guān)鍵字： 空間激光通信  精跟蹤技術(shù)  FPGA  

基于FPGA的紅外序列圖像動態(tài)壓縮顯示

  • 高位寬紅外相機數(shù)字視頻信號在向8位寬模擬信號線性壓縮顯示轉(zhuǎn)換時存在細節(jié)丟失的現(xiàn)象。針對這一問題,提出了一種新算法,即先利用高斯濾波器對紅外數(shù)字圖像進行低通濾波,然后將低頻圖像進行線性壓縮后再進行直方圖均衡運算,之后與濾波產(chǎn)生的高頻細節(jié)信號進行疊加后送到D/A芯片進行模擬顯示。詳細討論了該算法在FPGA嵌入式系統(tǒng)上的具體硬件結(jié)構(gòu)和實現(xiàn)方法,并對12位相機采集的圖像進行了實時壓縮顯示實驗。
  • 關(guān)鍵字： 圖像高頻噪聲  實時壓縮  FPGA  

基于XC2S600E的MJPEG編碼器研究與實現(xiàn)

  • 以JPEG基本壓縮原理為根據(jù),通過前端圖像采集芯片SAA7111輸出標(biāo)準(zhǔn)的4∶2∶2格式的圖像流,再在Xilinx公司的XC2S600E(FPGA)芯片下壓縮,獲得了良好效果,壓縮比達到10∶1.
  • 關(guān)鍵字： JPEG  前端圖像采集  FPGA  

基于FPGA的網(wǎng)絡(luò)化HID電子鎮(zhèn)流器控制芯片的研究

  • 本文利用FPGA作為平臺,設(shè)計了包括DALI通訊協(xié)議棧和數(shù)字化的恒功率PI控制模塊的HID控制芯片。本文首先利用理論分析和仿真設(shè)計給出了通訊協(xié)議與PI控制器的計算機仿真設(shè)計與驗證,分析了系統(tǒng)的工作性能,在此基礎(chǔ)上設(shè)計出了基于FPGA硬件平臺的DALI的通訊協(xié)議棧,為網(wǎng)絡(luò)化鎮(zhèn)流器的設(shè)計提供了完備的通訊接口和可供用戶直接調(diào)用的通訊協(xié)議編解碼平臺,設(shè)計出了可實現(xiàn)全橋HID燈恒流、恒功率逆變功能的數(shù)字PI控制模塊,通過實驗驗證,該控制芯片的功能齊全,恒流、恒功率控制精度高、響應(yīng)快,且控制策略更加靈活和準(zhǔn)確可靠,
  • 關(guān)鍵字： DALI通訊協(xié)議棧  HID控制  FPGA  

基于FPGA的ATM采集卡的設(shè)計與實現(xiàn)

  • 4口155M異步傳送模式(asynchronous transfer mode,ATM)業(yè)務(wù)采集卡實現(xiàn)對4個155 M ATM overSDH/SONET接口的數(shù)據(jù)采集,基于大容量FPGA(field programmable gate array)實現(xiàn)AAL2/AAL5的線速信元重組,重組后生成的AAL2SSSAR-SDU/AAL5 CPCS-SDU加上時間戳、ATM通道標(biāo)識后,封裝成以太網(wǎng)報文,通過采集輸出口輸出給信令協(xié)議分析服務(wù)器,可實現(xiàn)對Iu-CS、Iu-PS接口的信令監(jiān)測,同時支持cell m
  • 關(guān)鍵字： ATM  異步傳送模式  FPGA  

基于FPGA的高精度超聲波溫度計設(shè)計

  • 超聲波溫度計作為當(dāng)今新型溫度傳感器的一種，已經(jīng)成為新的有前景的測溫方法,并已經(jīng)應(yīng)用于發(fā)電廠、垃圾焚燒爐、水泥回轉(zhuǎn)窯等工業(yè)過程的溫度測量和控制以及一些醫(yī)療領(lǐng)域中。
  • 關(guān)鍵字： 溫度傳感器  超聲波測溫  FPGA  

基于DSP EMIF口及FPGA設(shè)計并實現(xiàn)多DSP嵌入式系統(tǒng)

  • 在實時圖像處理、雷達信號處理、軟件無線電、電子對抗、3G數(shù)值仿真計算中，單DSP無法滿足實時性和高速運算量要求，往往需要多DSP進行協(xié)同處理。本文針對DSP的EMIF接口和FPGA的特點，設(shè)計8個DSP通信的嵌入式系統(tǒng)。
  • 關(guān)鍵字： 多DSP嵌入式系統(tǒng)  EMIF  FPGA  

基于FPGA和PCI的AFDX終端接口卡設(shè)計

  • 航空電子全雙工交換式以太網(wǎng)(AFDX)是在商用以太網(wǎng)的基礎(chǔ)上經(jīng)過改進實時性和可靠性建立起來的。依據(jù)ARINC664規(guī)范第7部分對終端接口卡時延和抖動的性能要求，提出基于FPGA和PCI的AFDX終端接口卡的整體設(shè)計方案，對發(fā)送和接收模塊等關(guān)鍵模塊進行了設(shè)計，并分析了PCI接口驅(qū)動程序。測試結(jié)果表明,該接口卡實時性好、傳輸速率高、穩(wěn)定可靠，符合AFDX協(xié)議標(biāo)準(zhǔn)。
  • 關(guān)鍵字： 全雙工交換式以太網(wǎng)  實時性  FPGA  

基于FPGA的四通道視頻縮放引擎的研究及設(shè)計

  • 設(shè)計了一種可實現(xiàn)4路視頻信號縮放和幀率轉(zhuǎn)換的電路架構(gòu)。視頻信號依次經(jīng)過縮小模塊、幀率轉(zhuǎn)換模塊以及放大模塊，有效地減少了幀率轉(zhuǎn)換對存儲器帶寬的需求。
  • 關(guān)鍵字： 幀率轉(zhuǎn)換  加權(quán)均值算法  FPGA  

LTE上行DFT/IDFT的一種設(shè)計實現(xiàn)

  • MSL4163提供1MHz I2C串口，器件包括先進的PWM引擎以及片上EEPROM等。主要用在電視和臺式電腦監(jiān)視器、醫(yī)療、工業(yè)儀表和汽車音/視頻顯示器。本文介紹了MSL4163/MSL4164主要特性、方框圖和典型應(yīng)用電路、級聯(lián)連接電路。
  • 關(guān)鍵字： 3GPP協(xié)議  流水線結(jié)構(gòu)  FPGA  

基于VHDL+FPGA的自動售貨機控制模塊的設(shè)計與實現(xiàn)

  • EDA技術(shù)是以計算機為工具完成數(shù)字系統(tǒng)的邏輯綜合、布局布線和設(shè)計仿真等工作。電路設(shè)計者只需要完成對系統(tǒng)功能的描述，就可以由計算機軟件進行系統(tǒng)處理，最后得到設(shè)計結(jié)果，并且修改設(shè)計方案如同修改軟件一樣方便。
  • 關(guān)鍵字： VHDL  EDA  FPGA  

數(shù)字基帶預(yù)失真系統(tǒng)中環(huán)路延遲估計的FPGA實現(xiàn)

  • 基于FPGA芯片Stratix II EP2S60F672C4設(shè)計實現(xiàn)了數(shù)字基帶預(yù)失真系統(tǒng)中的環(huán)路延遲估計模塊。該模塊運用了一種環(huán)路延遲估計新方法，易于FPGA實現(xiàn)。同時，在信號失真的情況下也能給出正確的估計結(jié)果。Modelsim SE 6.5c的時序仿真結(jié)果和SignalTaps II的硬件調(diào)試結(jié)果驗證了模塊的有效性。
  • 關(guān)鍵字： 數(shù)字基帶預(yù)失真系統(tǒng)  環(huán)路延遲估計  FPGA  

基于單片SRAM和FPGA的紅外圖像顯示的設(shè)計及實現(xiàn)

  • 介紹一種采用單片SRAM和FPGA實現(xiàn)紅外圖像顯示的新方案，并對顯示系統(tǒng)結(jié)構(gòu)、FPGA各功能模塊設(shè)計、SRAM的讀/寫時序設(shè)計進行了詳細論述。該圖像顯示方案可用于紅外圖像處理系統(tǒng)的硬件調(diào)試和紅外圖像處理效果觀測。
  • 關(guān)鍵字： 紅外圖像顯示  SRAM  FPGA  

基于FPGA的VHDL語言電路優(yōu)化設(shè)計

  • 在VHDL語言電路優(yōu)化設(shè)計當(dāng)中，優(yōu)化問題主要包括面積優(yōu)化和速度優(yōu)化。面積優(yōu)化是指CPLD／FPGA的資源利用率優(yōu)化，即用盡可能少的片內(nèi)資源實現(xiàn)更多電路功能；速度優(yōu)化是指設(shè)計系統(tǒng)滿足一定的速度要求。
  • 關(guān)鍵字： 電路優(yōu)化設(shè)計  VHDL  FPGA  
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