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基于FPGA的GSM系統(tǒng)直放站數(shù)字選頻器設(shè)計(jì)
- 提出了一種基于FPGA的數(shù)字選頻器設(shè)計(jì)方案，該數(shù)字選頻器應(yīng)用于八通道的GSM系統(tǒng)直放站，采用低成本的FPGA芯片Xilink Spartan-3A DSP XC3SD3400A進(jìn)行數(shù)字信號處理。給出了較詳細(xì)的硬件設(shè)計(jì)方案，并通過Agilent Technologies N5230A網(wǎng)絡(luò)分析儀對數(shù)字選頻器進(jìn)行了測量，被選出的有效相鄰信道之間的最小間隔能達(dá)到1MHz，能夠?qū)崿F(xiàn)較好的選頻功能，可滿足實(shí)際應(yīng)用的要求。
- 關(guān)鍵字： 數(shù)字選頻器 MSP430 FPGA
基于VHDL的感應(yīng)加熱電源數(shù)字移相觸發(fā)器設(shè)計(jì)
- 用數(shù)字觸發(fā)器的設(shè)計(jì)思想設(shè)計(jì)其硬件結(jié)構(gòu)并對軟件算法進(jìn)行了改進(jìn)。改進(jìn)后的數(shù)字移相觸發(fā)器簡單可靠，產(chǎn)生脈沖的對稱性好，抗干擾能力強(qiáng)，能夠保證捕獲到每一個(gè)換相區(qū)并及時(shí)觸發(fā)。
- 關(guān)鍵字： 鎖相環(huán)倍頻 脈沖觸發(fā)模塊 FPGA
基于FPGA的脈沖重復(fù)頻率(PRF)跟蹤器的設(shè)計(jì)
- 本文利用FPGA資源豐富?易于編程的特點(diǎn)設(shè)計(jì)了純硬方式的脈沖重復(fù)頻率跟蹤器,實(shí)現(xiàn)了在密集信號環(huán)境下的信號跟蹤,并且將多路并行的跟蹤器集成在一片F(xiàn)PGA中,簡化了系統(tǒng)結(jié)構(gòu),縮小了體積?
- 關(guān)鍵字： 多路脈沖重復(fù)頻率跟蹤器 關(guān)聯(lián)比較器 FPGA
FPGA在航空電子系統(tǒng)中的設(shè)計(jì)應(yīng)用
- 由于競爭的壓力和對飛機(jī)性能無止境的追求，航空電子從簡單、獨(dú)立的設(shè)備發(fā)展到如今以每秒百萬位乃至更快的速度交換信息的高級智能系統(tǒng)網(wǎng)絡(luò)。這也帶來了必須克服的許多設(shè)計(jì)問題。
- 關(guān)鍵字： 高級智能系統(tǒng)網(wǎng)絡(luò) 航空電子 FPGA
有限狀態(tài)機(jī)的FPGA設(shè)計(jì)
- 有限狀態(tài)機(jī)是一種常見的電路，由于時(shí)序電路和組合電路組成，設(shè)計(jì)有限狀態(tài)機(jī)的第一步是確定采用Moore狀態(tài)機(jī)還是采用Mealy狀態(tài)機(jī)。Mealy狀態(tài)機(jī)的狀態(tài)轉(zhuǎn)變不僅和當(dāng)前狀態(tài)有關(guān)，而且和各輸入信號有關(guān)；Moore狀態(tài)機(jī)的轉(zhuǎn)變只和當(dāng)前狀態(tài)有關(guān)。從電路實(shí)現(xiàn)功能上來講，任何一種都可以實(shí)現(xiàn)同樣的功能。但他們的輸出時(shí)序不同，所以選擇使用哪種狀態(tài)機(jī)是要根據(jù)具體情況來定。
- 關(guān)鍵字： Moore狀態(tài)機(jī) Mealy狀態(tài)機(jī) FPGA
基于FPGA的帶Cache的嵌入式CPU的設(shè)計(jì)與實(shí)現(xiàn)
- MIPS(Microprocessor without Interlocked Pipeline STages)是一種典型的RISC(Reduced InstructiON Set Computer)微處理器,在嵌入式系統(tǒng)領(lǐng)域中得到廣泛的應(yīng)用。MIPS32TM指令集開放，指令格式規(guī)整，易于流水線設(shè)計(jì)，大量使用寄存器操作。與CISC(Complex Instruction Set Computer)微處理器相比，RISC具有設(shè)計(jì)更簡單、設(shè)計(jì)周期更短等優(yōu)點(diǎn)，并可以應(yīng)用更多先進(jìn)的技術(shù)，開發(fā)更快的下一代處理器。
- 關(guān)鍵字： 流水線CPU 時(shí)序設(shè)計(jì) FPGA
基于ARM的SoC FPGA嵌入式系統(tǒng)的設(shè)計(jì)實(shí)現(xiàn)
- 本白皮書討論用于實(shí)現(xiàn)基于ARM 的嵌入式系統(tǒng)的Altera 可編程芯片系統(tǒng)(SoC)方法。對于面臨產(chǎn)品及時(shí)面市、成本、性能、設(shè)計(jì)重用和產(chǎn)品長壽命等苛刻要求的嵌入式系統(tǒng)開發(fā)人員而言，單芯片方案是非常有價(jià)值的方法。
- 關(guān)鍵字： 硬核處理器 嵌入式系統(tǒng) FPGA
FPGA大型設(shè)計(jì)應(yīng)用的多時(shí)鐘設(shè)計(jì)策略闡述
- 利用FPGA實(shí)現(xiàn)大型設(shè)計(jì)時(shí)，可能需要FPGA具有以多個(gè)時(shí)鐘運(yùn)行的多重?cái)?shù)據(jù)通路，這種多時(shí)鐘FPGA設(shè)計(jì)必須特別小心，需要注意最大時(shí)鐘速率、抖動、最大時(shí)鐘數(shù)、異步時(shí)鐘設(shè)計(jì)和時(shí)鐘/數(shù)據(jù)關(guān)系。設(shè)計(jì)過程中最重要的一步是確定要用多少個(gè)不同的時(shí)鐘，以及如何進(jìn)行布線，本文將對這些設(shè)計(jì)策略深入闡述。
- 關(guān)鍵字： 亞穩(wěn)態(tài)性 多時(shí)鐘 FPGA
基于分層測試的Virtex系列FPGA互聯(lián)資源測試新方法
- 以基于靜態(tài)隨機(jī)存儲器(SRAM)的現(xiàn)場可編程門陣列(FPGA)為例，在傳統(tǒng)的三次測試方法的基礎(chǔ)上提出了一種新穎的針對FPGA互聯(lián)資源的測試方法。該方法運(yùn)用了層次化的思想，根據(jù)開關(guān)矩陣中可編程互聯(lián)點(diǎn)(PIP)兩端連線資源的區(qū)別將互聯(lián)資源進(jìn)行層次化分類，使得以這種方式劃分的不同類別的互聯(lián)資源能夠按一定方式進(jìn)行疊加測試，這就從根本上減少了實(shí)際需要的測試配置圖形和最小配置次數(shù)。
- 關(guān)鍵字： 互聯(lián)資源 分層測試 FPGA
基于FPGA的超級電容充放電控制
- 由于超級電容器單體性能參數(shù)的離散性，當(dāng)多個(gè)單體串聯(lián)組成電容器組時(shí)，在充放電過程中容易造成過充或過放現(xiàn)象，嚴(yán)重危害超級電容器的使用壽命。文中提出以FPGA為檢測、控制單元，對電容進(jìn)行有效地充放電控制，防止過充或過放，提高超級電容器的循環(huán)使用次數(shù)，降低不必要的能量消耗。
- 關(guān)鍵字： 超級電容 串聯(lián)均壓 FPGA
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