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基于FPGA和PCI的高精度測(cè)速板卡的設(shè)計(jì)與實(shí)現(xiàn)

  • 摘要：經(jīng)典的碼盤數(shù)字測(cè)速方法有M法、T法、M／T法，但都有一定的不足。為了克服原有方法的不足，設(shè)計(jì)并實(shí)現(xiàn)了一種在較大速度范圍都有良好精度和良好快速性的測(cè)速方法。電路采用FPGA實(shí)現(xiàn)，測(cè)速得到的數(shù)據(jù)通過PCI總線從
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高速PCB設(shè)計(jì)下的EMI規(guī)則探討

  • 隨著，信號(hào)上升沿時(shí)間的減小，信號(hào)頻率的提高，電子產(chǎn)品的EMI問題，也來越受到電子工程師的光注。高速PCB設(shè)計(jì)的成功 ...
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基于FPGA的超聲診斷儀動(dòng)態(tài)濾波器的設(shè)計(jì)

  • 采用FPGA的模擬動(dòng)態(tài)濾波器，在結(jié)構(gòu)上簡(jiǎn)易，性能上穩(wěn)定，測(cè)試和設(shè)計(jì)都十分的方便。FPGA的使用，能根據(jù)具體要求很方便的改變控制信號(hào)，同時(shí)實(shí)現(xiàn)超聲診斷儀中多個(gè)模塊并行工作，也為以后的更多模擬部分?jǐn)?shù)字化提供了基礎(chǔ)。
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基于FPGA的CCD相機(jī)時(shí)序發(fā)生器的設(shè)計(jì)

  • 本文分析了IL-E2型TDI-CCD 芯片的工作過程和對(duì)驅(qū)動(dòng)信號(hào)的要求，在此基礎(chǔ)上設(shè)計(jì)出合理的時(shí)序電路， 為了滿足在實(shí)際工作中像移速度異速匹配的要求，在時(shí)序電路的設(shè)計(jì)中時(shí)序發(fā)生部分是可調(diào)的。這種設(shè)計(jì)方案簡(jiǎn)單、可靠、實(shí)用。
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Bulgin新型PCB安裝保險(xiǎn)絲座面世

  • 　　作為Arcolectric、Bulgin 和 Sifam 國際電子制造品牌的擁有者，Elektron Technology日前推出了兩款全新的垂直型印刷電路板板級(jí)安裝(PCB-mounting)保險(xiǎn)絲座FX0442和FX0443，這兩款新設(shè)計(jì)屬于該公司旗下產(chǎn)品門類豐富的Bulgin保險(xiǎn)絲座系列。 　　FX0442和FX0443這兩款保險(xiǎn)絲座能夠容納尺寸為5x20mm的保險(xiǎn)絲，額定工作值為10A、250V ac，最大功率損耗是2.5W。它們專為各種批量應(yīng)用設(shè)計(jì)和制造，在這些應(yīng)用中PCB安裝提供了一種將
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基于FPGA+ DSP的實(shí)時(shí)圖像處理系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn)

  • 基于FPGA+ DSP的實(shí)時(shí)圖像處理系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn),摘 要: 針對(duì)圖像處理系統(tǒng)計(jì)算量大、實(shí)時(shí)性高和體積小的要求， 研制了一種以DSP為主處理器FPGA 為輔處理器的高性能實(shí)時(shí)圖像處理系統(tǒng)。利用這兩種芯片的各自特點(diǎn)， 將算法分成兩部分分別交由FPGA 和DSP處理， 大大提高
  • 關(guān)鍵字： FPGA，DSP  

基于FPGA的8085A CPU結(jié)構(gòu)分析與實(shí)現(xiàn)

  • 1 引 言

    微型計(jì)算機(jī)原理幾乎是所有理工科類大學(xué)生的必修課目之一， 其重要性不言而喻。然而大多數(shù)教學(xué)側(cè)重于應(yīng)用方面， 對(duì)計(jì)算機(jī)的結(jié)構(gòu)及工作原理涉之不深， 因?yàn)闊o法做一個(gè)CPU 來演示。這樣學(xué)生不能真正了解
  • 關(guān)鍵字： 8085A  FPGA  CPU  結(jié)構(gòu)分析    

基于邏輯分析內(nèi)核的FPGA電路內(nèi)調(diào)試技術(shù)

  • 隨著FPGA融入越來越多的能力，對(duì)有效調(diào)試工具的需求將變得至關(guān)重要。對(duì)內(nèi)部可視能力的事前周密計(jì)劃將能使研制組采用正確的調(diào)試戰(zhàn)略，以更快完成他們的設(shè)計(jì)任務(wù)。

    “我知道我的設(shè)計(jì)中存在一個(gè)問題，但我沒有很
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15段LED電平顯示DIY 線路簡(jiǎn)單

  • 十五段的LED顯示，用三塊芯片搞定，線路很簡(jiǎn)單。5V供電時(shí)，全部點(diǎn)亮的輸入電壓是Vp-p 2.5V；9V供電時(shí)，全部點(diǎn)亮的輸 ...
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單片機(jī)實(shí)驗(yàn)學(xué)習(xí)板DIY講解

  • 由于感覺隨時(shí)用萬用面包板搭電路做實(shí)驗(yàn)有些費(fèi)事！干脆畫PCB做了些單片機(jī)試驗(yàn)板，專門給大家講解，大家也好理解一 ...
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DIY 用感光膜曝光制作PCB

  • 使用感光膜曝光制作PCB！這種方法制作的PCB精度可以做到0.2mm以下。1、準(zhǔn)備工具 覆銅板、感光膜、菲林（或 ...
  • 關(guān)鍵字： 音響  DIY  感光膜曝光  PCB  制作  

Cadence為復(fù)雜的FPGA/ASIC設(shè)計(jì)提高驗(yàn)證效率

  • 　　全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司,今天宣布在幫助ASIC與FPGA設(shè)計(jì)者們提高驗(yàn)證效率方面取得最新重大進(jìn)展。加上對(duì)最新Accellera Universal Verification Methodology (UVM) 1.0業(yè)界標(biāo)準(zhǔn)的全面支持，600多種新功能擴(kuò)展了指標(biāo)驅(qū)動(dòng)型驗(yàn)證(MDV)的范圍，幫助工程師實(shí)現(xiàn)更快、更全面的驗(yàn)證閉合與硅實(shí)現(xiàn)。 　　
  • 關(guān)鍵字： Cadence  FPGA  

高階累積量調(diào)制識(shí)別改進(jìn)算法的FPGA實(shí)現(xiàn)

  • 摘要：基于高階累積量的數(shù)字調(diào)制信號(hào)識(shí)別算法在低信噪比環(huán)境下識(shí)別率較低。針對(duì)這一問題，提出了高階累積量的改進(jìn)算法，通過調(diào)整特征參數(shù)的判別順序先識(shí)別出MASK信號(hào)的方式，取得了較好的效果。討論了該算法的FPGA設(shè)
  • 關(guān)鍵字： FPGA  高階累積量  調(diào)制識(shí)別  改進(jìn)算法    

20個(gè)FPGA成功案例

  • 自 1985 年 Xilinx 向市場(chǎng)推出全球首款現(xiàn)場(chǎng)可編程門陣列 (FPGA) 以來，成千上萬的設(shè)計(jì)工程師充分利用其卓越的靈活性、可重復(fù)編程性、功能性和出眾的高性能及高容量構(gòu)建了各種令人稱贊的創(chuàng)新型產(chǎn)品，使我們的日常生活
  • 關(guān)鍵字： FPGA  案例    

利用LabVIEW和CompactRIO開發(fā)慣性檢管器

  • 挑戰(zhàn):尋找石油或者天然氣管道的參考位置，并確?？臻g誤差小于1米解決方案:通過使用LabVIE...
  • 關(guān)鍵字： FPGA  LabVIEW  CompactRIO  慣性檢管器  
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