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fsp:fpga-pcb
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FIR濾波器的FPGA實(shí)現(xiàn)方法
- 為了給實(shí)際應(yīng)用中選擇合適FIR濾波器的FPGA實(shí)現(xiàn)結(jié)構(gòu)提供參考,首先從FIR數(shù)字濾波器的基本原理出發(fā),分析了FIR濾波器的結(jié)構(gòu)特點(diǎn),然后分別介紹了基于FPGA的FIR濾波器的串行、并行、轉(zhuǎn)置型、FFT型和分布式結(jié)構(gòu)型的實(shí)現(xiàn)方法,對(duì)于各種實(shí)現(xiàn)的結(jié)構(gòu)做了分析、比較以及優(yōu)化處理,特別是對(duì)基于FFT的FIR濾波器與傳統(tǒng)卷積結(jié)構(gòu)進(jìn)行了精確的數(shù)值計(jì)算比較,最后得出滿足于低階或高階的各種FIR濾波器實(shí)現(xiàn)結(jié)構(gòu)的適用范圍及其優(yōu)缺點(diǎn),并針對(duì)實(shí)際工程應(yīng)用提出了下一步需解決的問(wèn)題。
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基于FPGA的24×24位低功耗乘法器的設(shè)計(jì)
- 通過(guò)對(duì)現(xiàn)有編碼算法的改進(jìn),提出一種新的編碼算法,它降低功耗的方法是通過(guò)減少部分積的數(shù)量來(lái)實(shí)現(xiàn)的。因?yàn)槌朔ㄆ鞯倪\(yùn)算主要是部分積的相加,因此,減少部分積的數(shù)量可以降低乘法器中加法器的數(shù)量,從而實(shí)現(xiàn)功耗的減低。在部分積的累加過(guò)程中.又對(duì)用到的傳統(tǒng)全加器和半加器進(jìn)行了必要的改進(jìn),避免了CMOS輸入信號(hào)不必要的翻轉(zhuǎn),從而降低了乘法器的動(dòng)態(tài)功耗。通過(guò)在Altera公司的FPGA芯片EP2CTOF896C中進(jìn)行功耗測(cè)試,給出了測(cè)試結(jié)果,并與現(xiàn)有的兩種編碼算法進(jìn)行了比較。功耗分別降低3.5%和8.4%。
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基于FPGA的多時(shí)鐘片上網(wǎng)絡(luò)設(shè)計(jì)
- 本文介紹了一個(gè)基于FPGA 的高效率多時(shí)鐘的虛擬直通路由器,通過(guò)優(yōu)化中央仲裁器和交叉點(diǎn)矩陣,以爭(zhēng)取較小面積和更高的性能。同時(shí),擴(kuò)展路由器運(yùn)作在獨(dú)立頻率的多時(shí)鐘NoC 架構(gòu)中,并在一個(gè)3×3Mesh 的架構(gòu)下實(shí)驗(yàn),分析其性能特點(diǎn),比較得出多時(shí)鐘片上網(wǎng)絡(luò)具有更高的性能。
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基于DSP Builder數(shù)字信號(hào)處理器的FPGA設(shè)計(jì)
- 針對(duì)使用硬件描述語(yǔ)言進(jìn)行設(shè)計(jì)存在的問(wèn)題,提出一種基于FPGA并采用DSP BuildIer作為設(shè)計(jì)工具的數(shù)字信號(hào)處理器設(shè)計(jì)方法。并按照Matlab/Simulink/DSP Builder/QuartusⅡ設(shè)計(jì)流程,設(shè)計(jì)了一個(gè)12階FIR低通數(shù)字濾波器,通過(guò)Quaxtus時(shí)序仿真及嵌入式邏輯分析儀signalTapⅡ硬件測(cè)試對(duì)設(shè)計(jì)進(jìn)行了驗(yàn)證。結(jié)果表明,所設(shè)計(jì)的FIR濾波器功能正確,性能良好。
- 關(guān)鍵字: Builder FPGA DSP 數(shù)字信號(hào)處理器
制作8片分時(shí)并聯(lián)DAC
- 08年底的時(shí)候,自己設(shè)計(jì)了8并聯(lián)的DAC(帖子見:http://bbs.hifidiy.net/viewthrea ... highlight=%2Bcdream),但 ...
- 關(guān)鍵字: DAC 設(shè)計(jì) PCB 機(jī)箱 并聯(lián)
采用MAX II器件實(shí)現(xiàn)FPGA設(shè)計(jì)安全解決方案
- 本文提供的解決方案可防止FPGA設(shè)計(jì)被拷貝,即使配置比特流被捕獲,也可以保證FPGA設(shè)計(jì)的安全性。通過(guò)在握手令牌由MAX II器件傳送給FPGA之前,禁止用戶設(shè)計(jì)功能來(lái)實(shí)現(xiàn)這種安全性。選用MAX II器件來(lái)產(chǎn)生握手令牌,這是因?yàn)樵撈骷哂蟹且资裕P(guān)電時(shí)可保持配置數(shù)據(jù)。而且,對(duì)于這種應(yīng)用,MAX II器件是最具成本效益的CPLD。本文還介紹了采用這種方案的一個(gè)參考設(shè)計(jì)。
- 關(guān)鍵字: FPGA MAX 器件 方案
擴(kuò)頻通信芯片STEL-2000A的FPGA實(shí)現(xiàn)
- 針對(duì)傳統(tǒng)集成電路(ASIC)功能固定、升級(jí)困難等缺點(diǎn),利用FPGA實(shí)現(xiàn)了擴(kuò)頻通信芯片STEL-2000A的核心功能。使用ISE提供的DDS IP核實(shí)現(xiàn)NCO模塊,在下變頻模塊調(diào)用了硬核乘法器并引入CIC濾波器進(jìn)行低通濾波,給出了DQPSK解調(diào)的原理和實(shí)現(xiàn)方法,推導(dǎo)出一種簡(jiǎn)便的引入π/4固定相移的實(shí)現(xiàn)方法。采用模塊化的設(shè)計(jì)方法使用VHDL語(yǔ)言編寫出源程序,在VIrtex-II Pro開發(fā)板上成功實(shí)現(xiàn)了整個(gè)系統(tǒng)。測(cè)試結(jié)果表明該系統(tǒng)正確實(shí)現(xiàn)了STEL-2000A的核心功能。
- 關(guān)鍵字: STEL 2000 FPGA 擴(kuò)頻通信
基于FPGA的光纖光柵解調(diào)系統(tǒng)的研究
- 波長(zhǎng)信號(hào)的解調(diào)是實(shí)現(xiàn)光纖光柵傳感網(wǎng)絡(luò)的關(guān)鍵,基于現(xiàn)有的光纖光柵傳感器解調(diào)方法,提出一種基于FPGA的雙匹配光纖光柵解調(diào)方法,此系統(tǒng)是一種高速率、高精度、低成本的解調(diào)系統(tǒng),并且通過(guò)引入雙匹配光柵有效地克服了雙值問(wèn)題同時(shí)擴(kuò)大了檢測(cè)范圍。分析了光纖光柵的測(cè)溫原理并給出了該方案軟硬件設(shè)計(jì),綜合考慮系統(tǒng)的解調(diào)精度和FPGA的處理速度給出了基于拉格朗日的曲線擬合算法。
- 關(guān)鍵字: FPGA 光纖光柵 解調(diào)系統(tǒng)
Altera發(fā)布28nm器件系列產(chǎn)品
- 為滿足用戶的多種設(shè)計(jì)需求,Altera公司 今天發(fā)布其28-nm器件系列產(chǎn)品,為業(yè)界提供最全面的器件選擇。Altera在Cyclone V和Arria V FPGA新系列、最新擴(kuò)展的Stratix V FPGA以及此前發(fā)布的HardCopy V ASIC系列中為用戶提供突出不同產(chǎn)品優(yōu)勢(shì)的解決方案。
- 關(guān)鍵字: Altera Stratix V FPGA
Power Integrations發(fā)布超薄表面貼裝型封裝電源IC
- ???????用于高能效電源轉(zhuǎn)換的高壓集成電路業(yè)界的領(lǐng)導(dǎo)者Power Integrations公司今日宣布其行業(yè)領(lǐng)先的TOPSwitch-JX電源轉(zhuǎn)換IC系列新增了創(chuàng)新的eSOP?超薄功率封裝形式。這款全新的超薄表面貼裝型封裝非常適合最大功率在65 W以下、不使用散熱片的緊湊敞開式設(shè)計(jì),如超薄LCD電視輔助電源、機(jī)頂盒、PC待機(jī)和DVD播放器等產(chǎn)品的電源。
- 關(guān)鍵字: Power Integrations TOPSwitch-JX eSOP PCB
fsp:fpga-pcb介紹
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