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EEPW首頁 >> 主題列表 >> fsp:fpga-pcb

常見電路板GND與外殼GND之間接一個電阻一個電容，為什么？

  • 外殼是金屬的，中間是一個螺絲孔，也就是跟大地連接起來了。這里通過一個1M的電阻跟一33個1nF的電容并聯(lián)，跟電路板的地連接在一起，這樣有什么好處呢？外殼地如果不穩(wěn)定或者有靜電之類的，如果與電路板地直接連接，就會打壞電路板芯片，加入電容，就能把低頻高壓，靜電之類的隔離起來，保護電路板。電路高頻干擾之類的會被電容直接接外殼，起到了隔直通交的功能。那為什么又加一個1M的電阻呢？這是因為，如果沒有這個電阻，電路板內(nèi)有靜電的時候，與大地連接的0.1uF的電容是隔斷了與外殼大地的連接，也就是懸空的。這些電荷積累到一定
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DC-DC轉(zhuǎn)換設(shè)計的要點

  • DC-DC轉(zhuǎn)換器可以實現(xiàn)各種電壓電平的高效電源轉(zhuǎn)換和供電，但是隨著需求的不斷上升，需要更高功率密度更高效率以及更小的尺寸，DC-DC轉(zhuǎn)換的PCB設(shè)計就更為重要了。下面說一說DC-DC轉(zhuǎn)換器PCB設(shè)計的一些要點：走線長度在高頻轉(zhuǎn)換器中，承載高速開關(guān)信號的走線長度對于保持信號完整性和降低EMI至關(guān)重要。較長的走線可以充當天線并輻射電磁能量，可能會對其他組件或電路造成干擾，此外，較長的走線可能會引起延遲、信號反射、寄生效應(yīng)，從而導(dǎo)致轉(zhuǎn)換器效率和穩(wěn)定性降低。因此走線長度應(yīng)該盡可能短，尤其是對于高速時鐘和數(shù)據(jù)時鐘，
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電源設(shè)計，這些細節(jié)要知道

  • 1. 變壓器圖紙、PCB、原理圖這三者的變壓器飛線位號需一致。理由：安規(guī)認證要求這是很多工程師在申請安規(guī)認證提交資料時會犯的一個毛病。2.X電容的泄放電阻需放兩組。理由：UL62368、CCC認證要求斷開一組電阻再測試X電容的殘留電壓。很多新手會犯的一個錯誤，修正的辦法只能重新改PCB Layout，浪費自己和采購打樣的時間。3.變壓器飛線的PCB孔徑需考慮到最大飛線直徑，必要是預(yù)留兩組一大一小的PCB孔。理由：避免組裝困難或過爐空焊問題因為安規(guī)申請認證通常會有一個系列，比如說24W申請一個系列，其中包含
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萊迪思Avant-X：捍衛(wèi)數(shù)字前沿

  • 現(xiàn)場可編程門陣列（FPGA）在當今的眾多技術(shù)中發(fā)揮著重要作用。從航空航天和國防到消費電子產(chǎn)品，再到關(guān)鍵基礎(chǔ)設(shè)施和汽車行業(yè)，F(xiàn)PGA在我們生活中不斷普及。與此同時對FPGA器件的威脅也在不斷增長。想要開發(fā)在FPGA上運行（固件）的IP需要花費大量資源，受這些FPGA保護的技術(shù)也是如此。這使得FPGA成為IP盜竊或破壞的潛在目標。防止IP盜竊、客戶數(shù)據(jù)泄露和系統(tǒng)整體完整性所需的安全功能已經(jīng)不可或缺。它們是許多FPGA應(yīng)用的基礎(chǔ)，在某些地區(qū)有相應(yīng)法律要求（例如，歐盟的GDPR、美國的HIPAA、英國的2018年
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【實戰(zhàn)】一個Buck電路設(shè)計的完整過程

  • 設(shè)計需求：硬十開發(fā)的一塊基于安路EG4X20BG256的FPGA板卡。該系統(tǒng)應(yīng)用于一個USB傳輸，可以進行多通道ADC數(shù)據(jù)采集的項目。整體框圖如下：實物如下：1、Buck控制器選型電源框圖制作過程，可以參考前期文檔：硬件總體設(shè)計之 “專題分析”我們可以看到在電源樹中，分別需要實現(xiàn)：5V→3.3V@2A5V→1.2V@2A5V→2.5V@2A此處我們選型的Buck電源控制器（集成Mosfet）是杰華特的JW5359從Datasheet我們可以看到：1、輸入電壓范圍滿足要求4.5V~18V2、輸出電流可以達到
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將ASIC IP核移植到FPGA上——更新概念并推動改變以完成充滿挑戰(zhàn)的任務(wù)!

  • 本系列文章從數(shù)字芯片設(shè)計項目技術(shù)總監(jiān)的角度出發(fā)，介紹了如何將芯片的產(chǎn)品定義與設(shè)計和驗證規(guī)劃進行結(jié)合，詳細講述了在FPGA上使用IP核來開發(fā)ASIC原型項目時，必須認真考慮的一些問題。文章從介紹使用預(yù)先定制功能即IP核的必要性開始，通過闡述開發(fā)ASIC原型設(shè)計時需要考慮到的IP核相關(guān)因素，用八個重要主題詳細分享了利用ASIC所用IP來在FPGA上開發(fā)原型驗證系統(tǒng)設(shè)計時需要考量的因素。在上篇文章中，我們介紹了將ASIC IP移植到FPGA原型平臺上的必要性，并對原型設(shè)計中各種考量因素進行了總體概述，分析開發(fā)A
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PCB發(fā)展簡史

  • 與歷史上的許多其他偉大發(fā)明一樣，我們今天所知的印刷電路板(PCB) 是建立在整個歷史進步的基礎(chǔ)之上的。在我們這個世界的小角落，可以追溯到 130 多年前 PCB 的歷史，當時世界上偉大的工業(yè)機器剛剛開始運轉(zhuǎn)。我們將在本文中介紹的不是完整的歷史，而是將 PCB 轉(zhuǎn)變?yōu)榻裉斓臉幼拥闹匾獣r刻。為什么是PCB？隨著時間的推移，PCB 已經(jīng)發(fā)展成為優(yōu)化電子產(chǎn)品制造的工具。曾經(jīng)很容易用手組裝的東西很快就讓位于需要機械精度和效率的微觀組件。以下圖所示的兩塊電路板為例。一個是 1960 年代制造的用于計算器的舊板。另一種
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國產(chǎn)FPGA，走到哪一步了？

  • 隨著人工智能（AI）技術(shù)的飛速發(fā)展，其應(yīng)用邊界不斷拓寬，從簡單的圖像識別到復(fù)雜的自然語言處理，再到自動駕駛、智能制造等前沿領(lǐng)域，AI 正以前所未有的速度改變著我們的世界。在這場 AI 革命中，深度學(xué)習(xí)作為其核心驅(qū)動力，不斷推動著算法與模型的革新，同時也對計算資源提出了更為嚴苛的要求。誕生于 1985 年的 FPGA 雖然問世時間不長，但已經(jīng)憑借「可編程」的獨特優(yōu)勢，在百花齊放的芯片浪潮中奪得一席之地，成為 GPU 芯片的又一勁敵。FPGA 的特點FPGA 芯片是基于可編程器件（PAL、GAL、CPLD）發(fā)
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將ASIC IP核移植到FPGA上——明了需求和詳細規(guī)劃以完成充滿挑戰(zhàn)的任務(wù)

  • 本文從數(shù)字芯片設(shè)計項目技術(shù)總監(jiān)的角度出發(fā)，介紹了如何將芯片的產(chǎn)品定義與設(shè)計和驗證規(guī)劃進行結(jié)合，詳細講述了在FPGA上使用IP核來開發(fā)ASIC原型項目時，必須認真考慮的一些問題。文章從介紹使用預(yù)先定制功能即IP核的必要性開始，通過闡述開發(fā)ASIC原型設(shè)計時需要考慮到的IP核相關(guān)因素，用八個重要主題詳細分享了利用ASIC所用IP來在FPGA上開發(fā)原型驗證系統(tǒng)設(shè)計時需要考量的因素。本篇文章是SmartDV數(shù)字芯片設(shè)計經(jīng)驗分享系列文章的第一篇，作為全球領(lǐng)先的驗證解決方案和設(shè)計IP提供商，SmartDV的產(chǎn)品研發(fā)及
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如何確保PCB設(shè)計文件滿足SMT加工要求？看這里！

  • 在電子制造業(yè)中，表面貼裝技術(shù)（SMT）已成為主流的生產(chǎn)方式，其高效、精密的特點要求PCB設(shè)計文件必須符合嚴格的加工標準。一、文件完整性檢查1.1 PCB原理圖與Gerber文件首先，需要確認客戶是否提供了完整的PCB原理圖及相應(yīng)的Gerber文件。PCB原理圖應(yīng)包含所有器件名、引腳數(shù)、引腳定義、接線電性、電氣參數(shù)等信息，這是PCB設(shè)計的基礎(chǔ)。Gerber文件則是PCB設(shè)計軟件生成的，用于指導(dǎo)實際生產(chǎn)的文件，包括外層道銅、內(nèi)層道銅、表面噴錫、過孔連通等關(guān)鍵信息。1.2 BOM表BOM表（Bill of Ma
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萊迪思全新推出邏輯優(yōu)化的通用FPGA拓展其小型FPGA產(chǎn)品組合

  • 萊迪思半導(dǎo)體，低功耗可編程器件的領(lǐng)先供應(yīng)商，今日宣布為其領(lǐng)先的小尺寸FPGA產(chǎn)品中再添一款邏輯優(yōu)化的全新萊迪思Certus-NX? FPGA器件。新產(chǎn)品包括兩款新器件，即Certus-NX-28?和Certus-NX-09?，擁有多種封裝選項，可提供行業(yè)領(lǐng)先的低功耗、小尺寸和可靠性以及靈活的遷移選項。這些器件旨在加速廣泛的通信、計算、工業(yè)和汽車應(yīng)用。萊迪思半導(dǎo)體產(chǎn)品營銷副總裁Dan Mansur表示：“萊迪思致力于在小型、低功耗FPGA領(lǐng)域持續(xù)創(chuàng)新，為我們的客戶提供優(yōu)化的解決方案，滿足空間受限的應(yīng)用需求，
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PCB焊盤上，到底可不可以打過孔

  • 在設(shè)計電路板時，有時因為板子面積的限制，或者走線比較復(fù)雜，會考慮將過孔打在貼片元件的焊盤上。一直以來都分為支持和反對兩種意見?，F(xiàn)將兩種觀點簡述如下。支持：網(wǎng)友A一般需要在焊盤上打過孔的目的是增強過電流能力或加強散熱，因此背面主要是鋪銅接電源或地，很少會放貼片元件，這樣為防止在回流焊時漏錫，可以將過孔背面加綠油，問題也就解決了，在我接觸過的服務(wù)器主板電源部分都是這么處理的.反對：網(wǎng)友B一般貼片元件可以采用回流焊工藝或波峰焊工藝中的一種,波峰焊要求焊盤密度不宜太高,焊盤太密容易造成連錫短路, 貼片IC腳都比較
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Sherlock8 AI 驅(qū)動的視覺檢測可以發(fā)現(xiàn)極小的納米級 PCB 缺陷

  • 手機行業(yè)的規(guī)模和競爭力推動了許多行業(yè)的投資和創(chuàng)新，從成像、軟件，甚至冶金。毫無疑問，半導(dǎo)體技術(shù)和市場受到了最大的沖擊和影響， 更小封裝更高性能是半導(dǎo)體市場幾十年來一直不懈的需求。?幾個月前，蘋果發(fā)布了最新款 iPhone，其中一些配備了臺灣臺積電生產(chǎn)的全新 3 納米制造工藝的新型 A17 仿生芯片。?據(jù)報道，蘋果采購了臺積電能夠生產(chǎn)的所有3nm芯片。?這些芯片比 5 納米前代芯片更小、更快、耗電更低、更節(jié)能。?據(jù)蘋果公司稱，每塊芯片都有 190 億個晶體
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利用強大的軟件設(shè)計工具為FPGA開發(fā)者賦能

  • 許多嵌入式系統(tǒng)的開發(fā)者都對使用基于FPGA的SoC系統(tǒng)感興趣，但是基于傳統(tǒng)HDL硬件描述語言的FPGA開發(fā)工具和復(fù)雜流程往往會令他們望而卻步。為了解決這一問題，萊迪思的Propel工具套件提供了基于圖形化設(shè)計方法的設(shè)計環(huán)境，用于創(chuàng)建，分析，編譯和調(diào)試基于FPGA的嵌入式系統(tǒng)，從而完成系統(tǒng)軟硬件設(shè)計。萊迪思的Propel工具套件由兩部分組成：Propel Builder提供圖形化的SoC系統(tǒng)和硬件設(shè)計，通過拖放方式，選擇處理器和相關(guān)的外設(shè)與IP，通過圖形化的方式進行配置和連接，從而完成系統(tǒng)層面的硬件設(shè)計；
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幾個賊有意思的電路

  • 【愛心流水燈】▲ 圖1 愛心流水燈? ● 電子器件：???LED：48???CD4017：1???NE555p：1???電阻：10k???電解電容：10uF/25V???電位器：103???電池：9V【電池電壓指示】▲ 圖2.1 電池電壓指示燈? ● 電子器件：???電阻：100Ω×4???LED：綠色LED×4???二極管：1N4007×3【白色燈柱】▲ 圖2.2 白色燈柱? ● 電子器件：???電阻：1k×6???LED：白色LED×6???電位器：5kΩ【閃爍燈環(huán)】▲
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fsp:fpga-pcb介紹

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