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技術(shù)與環(huán)保：PCB發(fā)展兩大主線

　　一年一度的中國(guó)國(guó)際電子電路展(CPCA SHOW)日前在上海舉行，與往屆展會(huì)不同的是，本次(第十六屆)CPCA SHOW與慕尼黑電子展及SEMICON China 2007一同在浦東上海新國(guó)際博覽中心舉辦，讓產(chǎn)業(yè)鏈上下游的眾多業(yè)內(nèi)人士了解了中國(guó)PCB產(chǎn)業(yè)的發(fā)展情況。中國(guó)已是PCB生產(chǎn)大國(guó) 　　印制電路板是信息產(chǎn)業(yè)的基礎(chǔ)，從計(jì)算機(jī)、電視機(jī)到電子玩具等，幾乎所有的電子電器產(chǎn)品中都有電路板存在。中國(guó)電子電路產(chǎn)業(yè)和中國(guó)電子信息產(chǎn)業(yè)一樣，在近年來(lái)一直保持著高速增長(zhǎng)。這一增長(zhǎng)趨勢(shì)還將持續(xù)到2010年或更長(zhǎng)一
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賽靈思為DSP優(yōu)化65nm FPGA

賽靈思公司(Xilinx, Inc.)宣布開始向市場(chǎng)交付針對(duì)高性能數(shù)字信號(hào)處理(DSP)而優(yōu)化的65nm Virtex-5 SXT現(xiàn)場(chǎng)可編程門陣列(FPGA)器件的首批產(chǎn)品。SXT平臺(tái)的DSP在550MHz下性能達(dá)352 GMAC，而且動(dòng)態(tài)功率較上一代90nm器件相比降低35%。Virtex-5 SXT平臺(tái)為無(wú)線WIMAX以及監(jiān)控和廣播等高分辨率視頻等領(lǐng)域中的高性能數(shù)字信號(hào)處理應(yīng)用提供了最高的DSP模塊和邏輯資源比。增強(qiáng)的DSP邏輯片(DSP48E)包括一個(gè)25 x 18位乘法器、一個(gè)48位第二級(jí)累加和算
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Altera發(fā)售業(yè)界首款65nm低成本FPGA

　　日前，Alter宣布，利用TSMC 65nm低功耗工藝的低成本FPGA Cyclone III系列開始發(fā)售。根據(jù)Altera廣播、汽車電子及消費(fèi)電子業(yè)務(wù)部副總裁Tim Colleran的介紹，利用TSMC的工藝，Cyclone III FPGA提供豐富的邏輯、存儲(chǔ)器和DSP方案功能功耗更低。結(jié)合Quartus II開發(fā)軟件7.0，Cyclone III系列在嚴(yán)格的成本和功耗預(yù)算下，以高性能滿足應(yīng)用需求。　　Altera資深營(yíng)銷副總裁Jordan Plofsky認(rèn)為，這一系列產(chǎn)品與其他競(jìng)爭(zhēng)對(duì)手的方案
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Altera中國(guó)大學(xué)生電子設(shè)計(jì)文章競(jìng)賽2007

Altera? 公司一直致力于通過(guò)大學(xué)合作項(xiàng)目的實(shí)施來(lái)幫助中國(guó)培養(yǎng)優(yōu)秀電子設(shè)計(jì)人才，并推動(dòng)可編程技術(shù)產(chǎn)品和應(yīng)用的研究。Altera中國(guó)大學(xué)計(jì)劃更是公司的一項(xiàng)長(zhǎng)期戰(zhàn)略計(jì)劃。Altera大學(xué)計(jì)劃為全球范圍內(nèi)的大專院校提供先進(jìn)、容易學(xué)習(xí)并容易使用的開發(fā)軟件、可編程邏輯器件、開發(fā)工具以及完整的設(shè)計(jì)套件。我們希望提高學(xué)生們?cè)陔娮釉O(shè)計(jì)領(lǐng)域方面的知識(shí)和能力，幫助他們畢業(yè)后在工作崗位上能夠發(fā)揮所長(zhǎng)，實(shí)現(xiàn)Altera幫助中國(guó)提升電子設(shè)計(jì)水平的承諾。首屆中國(guó)大學(xué)生電子設(shè)計(jì)文章競(jìng)賽在2006年成功舉辦，推動(dòng)了中國(guó)
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PCI Express——高速串行互聯(lián)接口標(biāo)準(zhǔn)

摘要：?本文介紹了PCI Express以及用FPGA實(shí)現(xiàn)PCI Express接口的優(yōu)勢(shì)。關(guān)鍵詞：?PCI Express；FPGA PCI Express是從PCI發(fā)展而來(lái)的一種系統(tǒng)互聯(lián)接口標(biāo)準(zhǔn)。PCI和PCI-X都是基于32位以及64位的并行總線，而PCI Express則使用高速串行總線。PCI Express后向兼容于PCI，能夠靈活地提供大峰值帶寬。表1對(duì)比了三種PCI標(biāo)準(zhǔn)的特性。表1 PCI標(biāo)準(zhǔn)對(duì)比一對(duì)同時(shí)工作的發(fā)送和接收通道被稱為一個(gè)通路。發(fā)送和接收通道使用低
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Altera Stratix II FPGA達(dá)到軍用溫度級(jí)標(biāo)準(zhǔn)

　　Altera公司宣布，其90nm高性能Stratix®II FPGA器件系列所有封裝型號(hào)均達(dá)到軍用溫度級(jí)標(biāo)準(zhǔn)。　　Altera的Stratix和Stratix®II器件能夠可靠地工作在商用、工業(yè)和軍用溫度級(jí)范圍內(nèi)，符合嚴(yán)格的規(guī)范標(biāo)準(zhǔn)。公司將工業(yè)級(jí)Stratix®II器件的工作范圍擴(kuò)展到-55
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pcb電路抗干擾

在電子系統(tǒng)設(shè)計(jì)中，為了少走彎路和節(jié)省時(shí)間，應(yīng)充分考慮并滿足抗干擾性的要求，避免在設(shè)計(jì)完成后再去進(jìn)行抗干擾的補(bǔ)救措施。形成干擾的基本要素有三個(gè)：（1）干擾源，指產(chǎn)生干擾的元件、設(shè)備或信號(hào)，用數(shù)學(xué)語(yǔ)言描述如下：du/dt， di/dt大的地方就是干擾源。如：雷電、繼電器、可控硅、電機(jī)、高頻時(shí)鐘等都可能成為干擾源。（2）傳播路徑，指干擾從干擾源傳播到敏感器件的通路或媒介。典型的干擾傳播路徑是通過(guò)導(dǎo)線的傳導(dǎo)和空間的輻射。（3）敏感器件，指容易被干擾的對(duì)象。如：A/D、D/A變換器，單片機(jī)，數(shù)字IC，
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Cadence的Global Route Environment技術(shù)為PCB設(shè)計(jì)制訂新標(biāo)準(zhǔn)

　　Cadence設(shè)計(jì)系統(tǒng)公司發(fā)布了面向Cadence® Allegro® PCB設(shè)計(jì)的Global Route Environment技術(shù)。這一革命性的技術(shù)結(jié)合了圖形化的互連流規(guī)劃架構(gòu)和層次化全局布線引擎，為PCB設(shè)計(jì)人員提供了自動(dòng)、智能的規(guī)劃和布線環(huán)境。作為首個(gè)將智能自動(dòng)化引入前所未有領(lǐng)域的自動(dòng)布線解決方案，Global Route Environment 技術(shù)代表了一次意義重大的飛躍，并建立了一種全新的PCB設(shè)計(jì)規(guī)
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Cadence為PCB設(shè)計(jì)制訂新標(biāo)準(zhǔn)Global Route Environment

　　Cadence設(shè)計(jì)系統(tǒng)公司今日發(fā)布了面向Cadence® Allegro® PCB設(shè)計(jì)的Global Route Environment技術(shù)。這一革命性的技術(shù)結(jié)合了圖形化的互連流規(guī)劃架構(gòu)和層次化全局布線引擎，為PCB設(shè)計(jì)人員提供了自動(dòng)、智能的規(guī)劃和布線環(huán)境。作為首個(gè)將智能自動(dòng)化引入前所未有領(lǐng)域的自動(dòng)布線解決方案，Global Route Environment 技術(shù)代表了一次意義重大的飛躍，并建立了一種全新的PCB設(shè)計(jì)規(guī)范。　　該技術(shù)問(wèn)世之前，PCB設(shè)計(jì)人員要花費(fèi)幾周或幾個(gè)月的時(shí)間
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基于FPGA的雷達(dá)脈沖壓縮系統(tǒng)設(shè)計(jì)

脈沖壓縮技術(shù)是指對(duì)雷達(dá)發(fā)射的寬脈沖信號(hào)進(jìn)行調(diào)制(如線性調(diào)頻、非線性調(diào)頻、相位編碼)，并在接收端對(duì)回波寬脈沖信號(hào)進(jìn)行脈沖壓縮處理后得到窄脈沖的實(shí)現(xiàn)過(guò)程。脈沖壓縮有效地解決了雷達(dá)作用距離與距離分辨率之間的矛盾，可以在保證雷達(dá)在一定作用距離下提高距離分辨率。線性調(diào)頻信號(hào)的脈沖壓縮脈沖壓縮的過(guò)程是通過(guò)對(duì)接收信號(hào)s(t)與匹配濾波器的脈沖響應(yīng)h(t)求卷積的方法實(shí)現(xiàn)的。而處理數(shù)字信號(hào)時(shí)，脈壓過(guò)程是通過(guò)對(duì)回波序列s(n)與匹配濾波器的脈沖響應(yīng)序列h(n)求卷積來(lái)實(shí)現(xiàn)的。匹配濾波器的輸出為： &nbs
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設(shè)計(jì)靈活、高性能的嵌入式系統(tǒng)

您的下一個(gè)嵌入式系統(tǒng)設(shè)計(jì)項(xiàng)目需要的是什么：是可以讓您輕松地定制設(shè)計(jì)的靈活的系統(tǒng)元件，還是額外的性能空間，以便您在設(shè)計(jì)周期中加入更多的功能？為什么要讓自己承受過(guò)度的開發(fā)壓力，并且只能舍此取彼呢？軟處理和IP定制能夠?yàn)橥瑫r(shí)確保靈活性和高性能提供了最佳的解決方案，將定制設(shè)計(jì)的概念和協(xié)處理帶來(lái)的性能加速結(jié)合起來(lái)。分立處理器只能提供固定的外設(shè)選擇，并且一些性能受到時(shí)鐘頻率的限制。在嵌入式 FPGA所提供的平臺(tái)上，您可以創(chuàng)建一個(gè)具有大量定制處理器核、靈活的外設(shè)、甚至協(xié)處理減負(fù)引擎的系統(tǒng)?，F(xiàn)在，您能設(shè)計(jì)出一個(gè)不折
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Altera發(fā)布Quartus II設(shè)計(jì)軟件7.0支持Cyclone III FPGA

　　Altera公司推出了Quartus® II軟件7.0，其訂購(gòu)版和免費(fèi)的網(wǎng)絡(luò)版均支持65nm Cyclone® III FPGA全系列產(chǎn)品。網(wǎng)絡(luò)版軟件對(duì)Cyclone III器件的支持表明，在所有FPGA供應(yīng)商免費(fèi)軟件包中，該軟件能夠支持密度最大的器件。與前一系列相比，Quartus II軟件的先進(jìn)技術(shù)和效能特性使設(shè)計(jì)人員能夠充分挖掘Cyclone III系列的潛能，器件功耗降低了50％，比最相近的低成本FPGA競(jìng)爭(zhēng)
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基于DSP的高速PCB抗干擾設(shè)計(jì)

引言隨著DSP(數(shù)字信號(hào)處理器)的廣泛應(yīng)用，基于DSP的高速信號(hào)處理PCB板的設(shè)計(jì)顯得尤為重要。在一個(gè)DSP系統(tǒng)中，DSP微處理器的工作頻率可高達(dá)數(shù)百M(fèi)Hz，其復(fù)位線、中斷線和控制線、集成電路開關(guān)、高精度A／D轉(zhuǎn)換電路，以及含有微弱模擬信號(hào)的電路都非常容易受到干擾；所以設(shè)計(jì)開發(fā)一個(gè)穩(wěn)定的、可靠的DSP系統(tǒng)，抗干擾設(shè)計(jì)非常重要。干擾即干擾能量使接收器處在不希望的狀態(tài)。干擾的產(chǎn)生分兩種：直接的(通過(guò)導(dǎo)體、公共阻抗耦合等)和間接的(通過(guò)串?dāng)_或輻射耦合)。很多電器發(fā)射源，如光照、電機(jī)和日光
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Actel和ARM聯(lián)合開發(fā)專為FPGA應(yīng)用而優(yōu)化的高性能32位處理器

Actel公司進(jìn)一步擴(kuò)展其工業(yè)標(biāo)準(zhǔn)處理器系列，宣布推出ARM Cortex-M1處理器，這是與ARM公司聯(lián)合開發(fā)的小型高性能32位軟件微處理器核，專為在FPGA中的實(shí)施而優(yōu)化。不象許多業(yè)界領(lǐng)先的處理器核通常需要支付授權(quán)費(fèi)用和權(quán)益金，Actel的客戶能夠免費(fèi)獲得先進(jìn)的ARM處理器技術(shù)如Cortex-M1，適用于廣闊的市場(chǎng)領(lǐng)域。免費(fèi)提供的Cortex-M1可與Actel以Flash為基礎(chǔ)且可運(yùn)行M1核的Actel Fusion FPGA和ProASIC3 FPGA同用，為設(shè)計(jì)人員提供編程靈活性和系統(tǒng)級(jí)集成，
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Altera Announces Quartus II Design Software Version 7.0 With Support for Cyclone III FPGAs

Web Edition Offers Free Design Support for Industry’s Highest-Density Low-Cost FPGAsBeijing, March 20, 2007—Altera Corporation (NASDAQ:ALTR) today introduced Quartus II software version 7.0 with support for the entire 65-nm Cyclone? III FPGA family in bot
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