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EEPW首頁 >> 主題列表 >> fsp:fpga-pcb

射頻集成電路的設(shè)計難點分析

  • 射頻集成電路的設(shè)計難點分析-如果RF電路的地線處理不當(dāng)，可能產(chǎn)生一些奇怪的現(xiàn)象。對于數(shù)字電路設(shè)計，即使沒有地線層，大多數(shù)數(shù)字電路功能也表現(xiàn)良好。而在RF頻段，即使一根很短的地線也會如電感器一樣作用。
  • 關(guān)鍵字： RF電路  PCB  

在pcb廠的你需要了解的新老qc七大手法

  • 在pcb廠的你需要了解的新老qc七大手法-在pcb廠里，品管新七大工具，其作用主要是用較便捷的手法來解決一些管理上的問題，與原來的“舊”品管七大手法相比，它主要應(yīng)用在中高層管理上，而舊七手法主要應(yīng)用在具體的實際工作中。
  • 關(guān)鍵字： pcb  

分享：六類模塊pcb調(diào)試技術(shù)

  • 分享：六類模塊pcb調(diào)試技術(shù)-在pcb抄板的設(shè)計過程中，我們常常要對pcb進(jìn)行調(diào)試與測試，六類模塊pcb的調(diào)試就是其中一種，本文對于CAt6、超CAT6+ 產(chǎn)品的pcb試制，具有重要的參考價值，讓大家更好的理解六類模塊pcb的調(diào)試技術(shù)。
  • 關(guān)鍵字： pcb  pcb調(diào)試  

相比GPU和GPP，F(xiàn)PGA是深度學(xué)習(xí)的未來？

  • 相比GPU和GPP，F(xiàn)PGA是深度學(xué)習(xí)的未來？-相比GPU和GPP，F(xiàn)PGA在滿足深度學(xué)習(xí)的硬件需求上提供了具有吸引力的替代方案。憑借流水線并行計算的能力和高效的能耗，F(xiàn)PGA將在一般的深度學(xué)習(xí)應(yīng)用中展現(xiàn)GPU和GPP所沒有的獨特優(yōu)勢。同時，算法設(shè)計工具日漸成熟，如今將FPGA集成到常用的深度學(xué)習(xí)框架已成為可能。未來，F(xiàn)PGA將有效地適應(yīng)深度學(xué)習(xí)的發(fā)展趨勢，從架構(gòu)上確保相關(guān)應(yīng)用和研究能夠自由實現(xiàn)。
  • 關(guān)鍵字： 機器學(xué)習(xí)  FPGA  GPU  GPP  

基于FPGA加速機器學(xué)習(xí)算法

  • 基于FPGA加速機器學(xué)習(xí)算法-AI因為其CNN（卷積神經(jīng)網(wǎng)絡(luò)）算法出色的表現(xiàn)在圖像識別領(lǐng)域占有舉足輕重的地位?；镜腃NN算法需要大量的計算和數(shù)據(jù)重用，非常適合使用FPGA來實現(xiàn)。上個月，Ralph Wittig（Xilinx CTO Office的卓越工程師） 在2016年OpenPower峰會上發(fā)表了約20分鐘時長的演講并討論了包括清華大學(xué)在內(nèi)的中國各大學(xué)研究CNN的一些成果。
  • 關(guān)鍵字： 機器學(xué)習(xí)  FPGA  

工程師必須要知道的FPGA引腳信號分配原則

  • 工程師必須要知道的FPGA引腳信號分配原則-現(xiàn)在的FPGA向引腳分配信號的任務(wù)曾經(jīng)很簡單，現(xiàn)在也變得相當(dāng)繁復(fù)。
  • 關(guān)鍵字： FPGA  FPGA引腳  

剖析FPGA在汽車系統(tǒng)設(shè)計中的關(guān)鍵作用

  • 剖析FPGA在汽車系統(tǒng)設(shè)計中的關(guān)鍵作用-選擇不同的微控制器系列時，軟件的兼容性是主要的障礙。大多數(shù)公司在軟件的開發(fā)、測試和驗證方面已經(jīng)進(jìn)行了大量的投入。因此，將設(shè)計轉(zhuǎn)換到一個新的架構(gòu)時，通常需要復(fù)雜且代價高昂的軟件移植。
  • 關(guān)鍵字： FPGA  汽車電子  微控制器  

如何用單個賽靈思FPGA數(shù)字化數(shù)百個信號

  • 如何用單個賽靈思FPGA數(shù)字化數(shù)百個信號-　　在新型賽靈思 FPGA 上使用低電壓差分信號（LVDS），只需一個電阻和一個電容就能夠數(shù)字化輸入信號。由于目前這一代賽靈思器件上提供有數(shù)百個 LVDS 輸入，理論上使用單個 FPGA 就能夠數(shù)字化數(shù)百個模擬信號。
  • 關(guān)鍵字： 賽靈思  FPGA  LVDS  

工程師談FPGA時序約束七步法

  • 工程師談FPGA時序約束七步法-時序例外約束包括FalsePath、MulticyclePath、MaxDelay、MinDelay。但這還不是最完整的時序約束。
  • 關(guān)鍵字： FPGA  PCB  接口電路  

FMC+ 標(biāo)準(zhǔn)將嵌入式設(shè)計推到全新的高度

  • FMC+ 標(biāo)準(zhǔn)將嵌入式設(shè)計推到全新的高度-更新后的 FPGA 夾層卡規(guī)范提供無與倫比的高 I/O 密度、向后兼容性。
  • 關(guān)鍵字： 嵌入式  FPGA  

如何擴展 FPGA 的工作溫度范圍

  • 如何擴展 FPGA 的工作溫度范圍-　　任何電子器件的使用壽命均取決于其工作溫度。在較高溫度下器件會加快老化，使用壽命會縮短。但某些應(yīng)用要求電子產(chǎn)品工作在器件最大額定工作結(jié)溫下。以石油天然氣產(chǎn)業(yè)為例來說明這個問題以及解決方案。
  • 關(guān)鍵字： 賽靈思  XA6SLX45  FPGA  

如何使用FPGA加速機器學(xué)習(xí)算法

  • 如何使用FPGA加速機器學(xué)習(xí)算法-　　當(dāng)前，AI因為其CNN（卷積神經(jīng)網(wǎng)絡(luò)）算法出色的表現(xiàn)在圖像識別領(lǐng)域占有舉足輕重的地位?；镜腃NN算法需要大量的計算和數(shù)據(jù)重用，非常適合使用FPGA來實現(xiàn)。上個月，Ralph Wittig（Xilinx CTO Office的卓越工程師）在2016年OpenPower峰會上發(fā)表了約20分鐘時長的演講并討論了包括清華大學(xué)在內(nèi)的中國各大學(xué)研究CNN的一些成果。
  • 關(guān)鍵字： FPGA  GPU  AuvizDNN  

FPGA實戰(zhàn)開發(fā)技巧（6）

  • FPGA實戰(zhàn)開發(fā)技巧（6）-時序性能是FPGA 設(shè)計最重要的指標(biāo)之一。造成時序性能差的根本原因有很多，但其直接原因可分為三類：布局較差、邏輯級數(shù)過多以及信號扇出過高。
  • 關(guān)鍵字： FPGA  時序性能  

FPGA實戰(zhàn)開發(fā)技巧（7）

  • FPGA實戰(zhàn)開發(fā)技巧（7）-通常我們會為工程添加UCF 約束指定時序要求和管腳約束。但是UCF 約束是給MAP，PAR 等實現(xiàn)使用的，綜合工具XST 并不能感知系統(tǒng)的時序要求。而為XST 添加XCF 約束卻是使實現(xiàn)結(jié)果擁有最高頻率的關(guān)鍵。
  • 關(guān)鍵字： FPGA  XCF  UCF  

利用FPGA的自身特性實現(xiàn)隨機數(shù)發(fā)生器

  • 利用FPGA的自身特性實現(xiàn)隨機數(shù)發(fā)生器-本文主要介紹利用FPGA的自身的特性實現(xiàn)隨機數(shù)發(fā)生器，在Virtex-II Pro開發(fā)板上用ChipScope觀察隨機數(shù)序列，以及在PCIe4Base（基于Virtex-4 FPGA）上實現(xiàn)。
  • 關(guān)鍵字： fpga  
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