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基于改進(jìn)型二步索引算法OSD電路的FPGA實(shí)現(xiàn)

基于改進(jìn)型二步索引算法OSD電路的FPGA實(shí)現(xiàn), 0 引言 OSD(on screen display)，即在屏顯示系統(tǒng)，是實(shí)現(xiàn)人機(jī)界面交互的基礎(chǔ)，在視頻處理SOC中作為重要功能模塊有著廣泛的應(yīng)用。基于SOC技術(shù)的模塊化設(shè)計(jì)要求各功能模塊盡可能小地占用電路資源，以滿足芯片系統(tǒng)
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基于FPGA的級(jí)聯(lián)結(jié)構(gòu)FFT處理器的優(yōu)化設(shè)計(jì)

0 引言
數(shù)字信號(hào)處理主要研究采用數(shù)字序列或符號(hào)序列表示信號(hào)，并用數(shù)字計(jì)算方法對(duì)這些序列進(jìn)行處理，以便把信號(hào)變換成符合某種需要的形式。在現(xiàn)代數(shù)字信號(hào)處理中，最常用的變換方法就是離散傅里葉變換(DFT)，
關(guān)鍵字： FPGA FFT 級(jí)聯(lián) 處理器

對(duì)基于FPGA的作戰(zhàn)系統(tǒng)時(shí)統(tǒng)的研究與設(shè)計(jì)

O引言作戰(zhàn)系統(tǒng)時(shí)間的統(tǒng)一同步(時(shí)統(tǒng))的重要性越來(lái)越得到重視，只有保證整個(gè)系統(tǒng)處在同一時(shí)間的基準(zhǔn)...
關(guān)鍵字： FPGA 作戰(zhàn)系統(tǒng) 時(shí)統(tǒng)

追新逐熱還是腳踏實(shí)地？跟上技術(shù)發(fā)展的步伐

　　我真的需要那種技術(shù)嗎?我現(xiàn)在應(yīng)該購(gòu)買(mǎi)嗎?如果我不購(gòu)買(mǎi)，是不是就會(huì)處于劣勢(shì)?我會(huì)不會(huì)因?yàn)樽龀鲥e(cuò)誤的決定而出局?即便不想成為先行者，同行的壓力與技術(shù)變化的速度，也會(huì)使我們不斷面對(duì)類(lèi)似的更多問(wèn)題。最終，我們還是得想辦法回到正確的技術(shù)軌道上來(lái)。　　研究、保持使用最新技術(shù)以及直覺(jué)，都將有助于縮小這些決定的范圍，不過(guò)最終還是得在冒險(xiǎn)一試與放棄之間做出選擇。即使有些不情愿或者也許有點(diǎn)晚，我們?nèi)匀粨碜o(hù)變革。　　在消費(fèi)類(lèi)電子產(chǎn)品前沿，事情并不總是那么順理成章的。無(wú)論行業(yè)評(píng)論員的權(quán)威意見(jiàn)是什么，也不管他們給予怎樣
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一種高精度RF信號(hào)幅相檢測(cè)電路的設(shè)計(jì)

一、引言在實(shí)際的RF 電路設(shè)計(jì)中，經(jīng)常會(huì)遇到檢測(cè)兩個(gè)信號(hào)之間的幅度比（增益）和相位差的問(wèn)題，這也是研究網(wǎng)絡(luò)相頻特性中不可缺少的重要方面。在某些特殊領(lǐng)域，尤其是在一個(gè)精確的窄頻段內(nèi)來(lái)進(jìn)行測(cè)量的要求下，這種
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32階FIR濾波器的FPGA實(shí)現(xiàn)

隨著軟件無(wú)線電的發(fā)展。對(duì)于濾波器的處理速度要求越來(lái)越高。傳統(tǒng)的FIR濾波器一般采用通用DSP處理器，但是DSP處理器采用的是串行運(yùn)算，而FPGA是現(xiàn)場(chǎng)可編程陣列，可以實(shí)現(xiàn)專(zhuān)用集成電路，另外還可以采用純并行結(jié)構(gòu)
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FPGA開(kāi)發(fā)中按鍵消抖與單脈沖發(fā)生器電路

FPGA開(kāi)發(fā)中常用到單脈沖發(fā)生器。一些文章介紹過(guò)產(chǎn)生單脈沖的電路，產(chǎn)生的單脈沖脈寬和相位都不能與時(shí)鐘同步，只能用在要求不嚴(yán)格的場(chǎng)合。筆者目前從事的課題中需要一個(gè)與時(shí)鐘周期等寬，相位與時(shí)鐘周期相同的鍵
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超越 SoC 的設(shè)計(jì)創(chuàng)新

　　大多數(shù)軟、硬件工程師都很熟悉 FPGA，這點(diǎn)應(yīng)該勿庸置疑。這種熟悉不見(jiàn)得是實(shí)質(zhì)性的熟悉，而是從概念上比較了解，也就是說(shuō) FPGA 功能的快速發(fā)展和成本的不斷下降是大家都不容忽略的優(yōu)勢(shì)。同時(shí)，他們也認(rèn)識(shí)到這種可編程器件顯然能方便地作為各種數(shù)字電路以及邏輯處理的高靈活度、低成本的載體。　　基本說(shuō)來(lái)，在設(shè)計(jì)方案中發(fā)揮 FPGA 的功能就是簡(jiǎn)單地映射出所需的邏輯，然后將其下載至適當(dāng)容量大小的器件中。這有些像大型處理器系統(tǒng)主體設(shè)計(jì)的輔助支持工作，而且在該層面上也確實(shí)發(fā)揮著自身的支持性作用。　　近期一些應(yīng)
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基于FPGA的溫度模糊自適應(yīng)PID控制器的設(shè)計(jì)

針對(duì)某恒溫箱控制系統(tǒng)中存在的非線性、時(shí)變等特點(diǎn)，結(jié)合傳統(tǒng)PID與現(xiàn)代模糊控制理論，以EP1C12型FP-GA為核心控制器，采用模塊化思想，設(shè)計(jì)并實(shí)現(xiàn)溫度模糊自適應(yīng)PID控制。實(shí)際運(yùn)行結(jié)果表明，采用該方法可明顯改善控制效果，在簡(jiǎn)化設(shè)計(jì)的同時(shí)，也可提高系統(tǒng)的運(yùn)算速度和可靠性。
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基于FPGA的8段數(shù)碼管動(dòng)態(tài)顯示IP核設(shè)計(jì)

設(shè)計(jì)基于FPGA的8段數(shù)碼管動(dòng)態(tài)顯示IP核，介紹8段數(shù)碼管內(nèi)部結(jié)構(gòu)及其驅(qū)動(dòng)顯示方式和IP核設(shè)計(jì)方法，給出8段數(shù)碼管動(dòng)態(tài)顯示IP核的Verilog HDL程序源代碼及其C語(yǔ)言驅(qū)動(dòng)程序。此IP核可例化成1～8個(gè)共陰極(或共陽(yáng)極)數(shù)碼管控制器，能方便地控制1～8個(gè)數(shù)碼管同時(shí)顯示數(shù)字和小數(shù)點(diǎn)位。測(cè)試結(jié)果表明，該IP核工作可靠、穩(wěn)定，可直接應(yīng)用于電子設(shè)計(jì)中。
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基于FPGA技術(shù)的數(shù)字相關(guān)器的設(shè)計(jì)與實(shí)現(xiàn)

1　引　言　　同步在通信系統(tǒng)中占有非常重要的地位,同步系統(tǒng)性能的高低在很大程度上決定了通信系統(tǒng)的質(zhì)量,甚至通信的成敗。相關(guān)器是同步系統(tǒng)的關(guān)鍵部件之一,因此,要求相關(guān)器須有比其它部件更高的可靠性。
關(guān)鍵字： FPGA 數(shù)字相關(guān)器

對(duì)基于FPGA的高速路由查找算法的研究

0引言隨著網(wǎng)絡(luò)流量的不斷增加和路由表容量的不斷增大，路由查找已經(jīng)成為制約因特網(wǎng)的主要瓶頸。盡...
關(guān)鍵字： FPGA 高速路由查找算法

基于ADC和FPGA脈沖信號(hào)測(cè)量的設(shè)計(jì)方案

0引言測(cè)頻和測(cè)脈寬現(xiàn)在有多種方法。通?；贛CU的信號(hào)參數(shù)測(cè)量，由于其MCU工作頻率很低，所以能夠達(dá)到...
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Vishay推出適用于線焊組裝的新PSC系列RF螺旋電感器

　　日前，Vishay Intertechnology, Inc.(NYSE 股市代號(hào)：VSH)宣布，推出用于線焊組裝的新系列RF螺旋電感器 --- Vishay Electro-Films PSC系列電感器 --- 具有低DCR、高Q值和寬感值范圍，提供RF等效電路模型，使得設(shè)計(jì)者可以對(duì)器件性能進(jìn)行高度精確的計(jì)算機(jī)仿真。　　PSC電感器是針對(duì)需要線焊器件的RF電路而設(shè)計(jì)的，包括在通信系統(tǒng)及測(cè)試測(cè)量?jī)x器中的阻抗調(diào)諧電路、集總元件濾波器和混合RF集成電路。　　螺旋電感具有1nH~100nH的寬感
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三維圖像信息處理FPGA+DSP核心架構(gòu)的設(shè)計(jì)與實(shí)現(xiàn)

三維圖像信息處理FPGA+DSP核心架構(gòu)的設(shè)計(jì)與實(shí)現(xiàn),三維圖像信息處理一直是圖像視頻處理領(lǐng)域的熱點(diǎn)和難點(diǎn)，目前國(guó)內(nèi)外成熟的三維信息處理系統(tǒng)不多，已有的系統(tǒng)主要依賴(lài)高性能通用PC完成圖像采集、預(yù)處理、重建、構(gòu)型等囊括底層和高層的處理工作。三維圖像處理數(shù)據(jù)量特
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