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一種基于FPGA的新型誤碼測試儀的設計與實現(xiàn)

　　引言　　誤碼儀是評估信道性能的基本測量儀器。本文介紹的誤碼儀結合FPGA 的特點,采用全新的積分式鑒相結構，提出了一種新的誤碼測試方法，經(jīng)多次測試驗證，方案可行，設計的系統(tǒng)穩(wěn)定。本文設計的誤碼儀由兩部分組成：發(fā)信機和接收機。　　1 發(fā)信機　　發(fā)信機的主要功能是產(chǎn)生具有隨機特性的偽隨機m 序列，通過FPGA 由VHDL 編程實現(xiàn)。偽隨機序列產(chǎn)生原理如下：　　　　圖1 偽隨機序列產(chǎn)生原理圖　　其中，ak-i是各移位寄存器的狀態(tài)，Ci對應各寄存器的反饋系數(shù)，為1表示參與反饋
關鍵字： FPGA 測試儀 VHDL MCU和嵌入式微處理器

異步通信起始位正確檢測的VHDL實現(xiàn)

　　摘要：基于FPGA/CPLD的UART設計眾多，本文分析了3倍頻采樣方法存在的不足，同時分析了16倍頻采樣對起始位檢測的可靠性，并給出相關的VHDL硬件描述語言程序代碼。　　關健詞：異步數(shù)據(jù);UART;FPGA/CPLD;VHDL 　　概述　　隨著電子設計自動化(EDA)技術的發(fā)展，可編程邏輯器件FPGA/CPLD已經(jīng)在許多方面得到了廣泛應用，而UART(通用異步收發(fā)器) 是在數(shù)字通信和控制系統(tǒng)中廣泛使用的串行數(shù)據(jù)傳輸協(xié)議。因此越來越多用戶根據(jù)自己的需要，以EDA技術作為開發(fā)手段，用一塊
關鍵字： 0711_A 雜志_設計天地嵌入式系統(tǒng) 單片機異步數(shù)據(jù) UART FPGA/CPLD VHDL MCU和嵌入式微處理器

基于狀態(tài)機的語音電子密碼鎖設計

　　引言　　隨著電子技術的發(fā)展，具有防盜報警、語音提示等功能的電子密碼鎖代替密碼量少、安全性差的機械式密碼鎖已是必然趨勢。目前大部分密碼鎖采用單片機進行設計，電路較復雜，性能不夠靈活。本文采用先進的EDA(電子設計自動化)技術，利用QuartusⅡ工作平臺和VHDL(超高速集成電路硬件描述語言)，設計了一種新型的電子密碼鎖。該密碼鎖具有密碼預置、修改、語音提示和3次輸入錯誤則系統(tǒng)進入定時鎖定并報警等功能，用FPGA(現(xiàn)場可編程門陣列)芯片和語音芯片ISD2560實現(xiàn)。由于充分利用了FPGA芯片密度大
關鍵字：工業(yè)控制 FPGA 電子密碼鎖 VHDL 遙控技術

單片機軟硬件聯(lián)合仿真解決方案

　　摘要：本文介紹一種嵌入式系統(tǒng)仿真方法，通過一種特殊設計的指令集仿真器ISS將軟件調試器軟件Keil uVision2和硬件語言仿真器軟件Modelsim連接起來，實現(xiàn)了軟件和硬件的同步仿真。關鍵詞：BFM，TCL，Verilog，Vhdl，PLI，Modelsim，Keil uVision2，ISS，TFTP，HTTP，虛擬網(wǎng)卡，Sniffer，SMART MEDIA，DMA，MAC，SRAM，CPLD 　　縮略詞解釋：　　BFM：總線功能模塊。在HDL
關鍵字： BFM TCL Verilog Vhdl PLI Modelsim MCU和嵌入式微處理器

SDRAM通用控制器的FPGA模塊化設計

摘要：介紹了一種SDRAM通用控制器的FPGA模塊化解決方案。關鍵詞： SDRAM控制器；FPGA；VHDL；狀態(tài)機；仲裁機制引言同步動態(tài)隨機存儲器(SDRAM)，在同一個CPU時鐘周期內即可完成數(shù)據(jù)的訪問和刷新，其數(shù)據(jù)傳輸速度遠遠大于傳統(tǒng)的數(shù)據(jù)存儲器(DRAM)，被廣泛的應用于高速數(shù)據(jù)傳輸系統(tǒng)中?；贔PGA的SDRAM控制器，以其可靠性高、可移植性強、易于集成的特點，已逐漸取代了以往的專用控制器芯片而成為主流解決方案。然而，SDRAM復雜的控制邏輯和要求嚴格的時序，成為開發(fā)過
關鍵字：消費電子 SDRAM控制器 FPGA VHDL 0708_A 雜志_設計天地工業(yè)控制

基于狀態(tài)機的語音電子密碼鎖設計

引言　　隨著電子技術的發(fā)展，具有防盜報警、語音提示等功能的電子密碼鎖代替密碼量少、安全性差的機械式密碼鎖已是必然趨勢。目前大部分密碼鎖采用單片機進行設計，電路較復雜，性能不夠靈活。本文采用先進的EDA(電子設計自動化)技術，利用QuartusⅡ工作平臺和VHDL(超高速集成電路硬件描述語言)，設計了一種新型的電子密碼鎖。該密碼鎖具有密碼預置、修改、語音提示和3次輸入錯誤則系統(tǒng)進入定時鎖定并報警等功能，用FPGA(現(xiàn)場可編程門陣列)芯片和語音芯片ISD2560實現(xiàn)。由于充分利用了FPGA芯片密度大、功
關鍵字：模擬技術電源技術 VHDL 語音電子密碼鎖模擬IC 電源

基于CPLD的PSK系統(tǒng)設計

1 引言　　現(xiàn)代通信系統(tǒng)要求通信距離遠、通信容量大、傳輸質量好。作為其關鍵技術之一的調制解調技術一直是人們研究的一個重要方向[5]。從模擬調制到數(shù)字調制，從二進制發(fā)展到多進制調制，雖然調制方式多種多樣，但都是朝著使通信系統(tǒng)更高速、更可靠的方向發(fā)展。一個系統(tǒng)的通信質量，很大程度上依賴于所采用的調制方式。因此，對調制方式的研究，將直接決定著通信系統(tǒng)質量的好壞[1]。　　復雜可編程邏輯器件（CPLD）結合了專用集成電路和DSP的優(yōu)勢，既具有很高的處理速度，又具有一定的靈活性。因此，基于CPLD的數(shù)字調
關鍵字：嵌入式系統(tǒng) 單片機 CPLD PSK 調制解調 VHDL 嵌入式

VHDL在高速圖像采集系統(tǒng)中的應用設計

　　現(xiàn)代化生產(chǎn)和科學研究對圖像采集系統(tǒng)的要求日益提高。傳統(tǒng)的圖像采集卡速度慢、處理功能簡單，不能很好地滿足特殊要求，因此，我們構建了高速圖像采集系統(tǒng)。它主要包括圖像采集模塊、圖像低級處理模塊以及總線接口模塊等。這些模塊是在FPGA中利用VHDL編程實現(xiàn)的。高速圖像采集系統(tǒng)主要用于視覺檢測。視覺檢測中圖像處理的特點是：底層圖像處理數(shù)據(jù)量大，算法簡單；高層圖像處理算法復雜，數(shù)據(jù)量大，算法簡單；高層圖像處理算法復雜，數(shù)據(jù)量小。對于圖像底層處理，我們在高速圖像采集系統(tǒng)中用FPGA實現(xiàn)，采用VHDL編寫圖像處理算法
關鍵字： VHDL 高速圖像采集

基于VHDL狀態(tài)機設計的智能交通控制燈

本文介紹的是一種最基本和簡單的交通燈設計情況，并且提供了一些模塊的源程序代碼。在此基礎上能夠舉一反三，從而用VHDL語言實現(xiàn)其它交通燈的控制設計。
關鍵字：智能交通控制設計狀態(tài) VHDL 基于

基于VHDL實現(xiàn)的十六路彩燈控制系統(tǒng)

本文介紹應用美國ALTERA公司的MAX+PLUSⅡ平臺，使用VHDL硬件描述語言實現(xiàn)的十六路彩燈控制系統(tǒng)。
關鍵字： VHDL 彩燈控制系統(tǒng)

基于梯形圖-VHDL的CPLD開發(fā)方法研究

本文通過對一個典型順序控制電路梯形圖的VHDL程序設計與時序仿真，表明梯形圖-VHDL設計方法是正確可行的。
關鍵字： VHDL CPLD 梯形圖方法研究

基于VHDL語言的卷積碼編解碼器的設計

1　引言數(shù)字信息在有噪信道中傳輸時，會受到噪聲干擾的影響，誤碼總是不可避免的。為了在已知信噪比的情況下達到一定的誤碼率指標，在合理設計基帶信號，選擇調制、解調方式，并采用頻域均衡或時域均衡措施的基礎上，還應采用差錯控制編碼等信道編碼技術，使誤碼率進一步降低。卷積碼和分組碼是差錯控制編碼的2種主要形式，在編碼器復雜度相同的情況下，卷積碼的性能優(yōu)于分組碼，因此卷積碼幾乎被應用在所有無線通信的標準之中，如GSM ，IS95和CDMA2000的標準中。目前,VHDL語言已成為EDA領域
關鍵字： VHDL 單片機卷積碼編嵌入式系統(tǒng)

用VHDL語言在CPLD上實現(xiàn)串行通信

引言隨著EDA技術得發(fā)展，CPLD已經(jīng)在許多方面得到了廣泛應用，而串行通信是實現(xiàn)遠程測控的重要手段。本文利用VHDL語言在CPLD上實現(xiàn)了串行通信，完全可以脫離單片機使用，克服了單片機的許多缺點。串口結構及內容本設計所采用的是異步通信方式，可以規(guī)定傳輸?shù)囊粋€數(shù)據(jù)是10位，其中最低位為啟動位(邏輯0低電平)，最高位為停止位(邏輯1高電平)，中間8位是數(shù)據(jù)位。為了方便對數(shù)據(jù)進行正確控制，選取發(fā)送(接受)每位數(shù)據(jù)用4個時鐘周期。為了能夠達到串行通信的波特率，例如4800B/s，則需把時鐘頻率設
關鍵字： CPLD VHDL 串行通信單片機嵌入式系統(tǒng)

8位單片機與以太網(wǎng)控制器RTL8029接口的VHDL設計

以CPLD為器件，采用VHDL語言，設計了51單片機與32位PCI總線以太網(wǎng)控制器RTL8029之間的接口邏輯，實現(xiàn)了8位單片機與3 2位以太網(wǎng)控制器之間的通信。
關鍵字： VHDL RTL 8位單片機

I2C總線控制器的VHDL設計及實現(xiàn)

摘要：本文用VHDL設計了一個簡潔而實用的I2C總線控制器，介紹了詳細的設計思路和在FPGA中的實現(xiàn)，并給出了在嵌入式系統(tǒng)設計中的使用方法。關鍵詞：I2C總線；VHDL；FPGA 引言I2C總線以其接口簡單、使用靈活等突出優(yōu)點在數(shù)字系統(tǒng)中獲得了廣泛的應用。尤其在嵌入式系統(tǒng)中，I2C總線被普遍用來連接CPU/MCU和外圍器件。I2C總線規(guī)范經(jīng)過十幾年的實踐，發(fā)展了多層標準。從傳輸速率上劃分，有標準模式(100Kbit/s)，快速模式(400Kbit/s)，高速模式(3
關鍵字： FPGA I2C總線 VHDL

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vhdl 介紹

VHDL的英文全名是Very-High-Speed Integrated Circuit HardwareDescription Language,誕生于1982年。1987年底，VHDL被IEEE和美國國防部確認為標準硬件描述語言。自IEEE公布了VHDL的標準版本，IEEE-1076（簡稱87版)之后，各EDA公司相繼推出了自己的VHDL設計環(huán)境，或宣布自己的設計工具可以和VHDL接口。此后 [ 查看詳細 ]

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