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EEPW首頁 >> 主題列表 >> fpga-pwm

利用FPGA的M4K作為移位寄存器的邏輯分析儀設(shè)計

  • 采用Altera公司的Cyclone系列EPlC3T144C8作為控制芯片，QuartusⅡ為軟件平臺，用硬件描速語言設(shè)計了一個具有變頻采樣時鐘和16路采樣通道，基于VGA顯示的邏輯分析僅．該設(shè)計方案利用FPGA內(nèi)部的M4K決作為移位寄存器不斷地進行讀進數(shù)據(jù)的方式，提高了工作速度、性能穩(wěn)定性以及分析的范圍和質(zhì)量。該邏輯分析儀實現(xiàn)簡單，價格低，具有較高的使用價值。
  • 關(guān)鍵字： 采樣模式  邏輯分析儀  FPGA  

基于FPGA的VLIW微處理器的設(shè)計與實現(xiàn)

  • 超長指令字VLIW微處理器架構(gòu)采用了先進的清晰并行指令設(shè)計。VLIW微處理器的最大優(yōu)點是簡化了處理器的結(jié)構(gòu)，刪除了處理器內(nèi)部許多復雜的控制電路，它能從應(yīng)用程序中提取高度并行的指令數(shù)據(jù)，并把這些機器指
  • 關(guān)鍵字： VLIW微處理器  并行指令控制  FPGA  

FPGA設(shè)計系統(tǒng)時鐘的影響因素及其分析

  • 時鐘是整個電路最重要、最特殊的信號，系統(tǒng)內(nèi)大部分器件的動作都是在時鐘的跳變沿上進行， 這就要求時鐘信號時延差要非常小， 否則就可能造成時序邏輯狀態(tài)出錯；因而明確FPGA設(shè)計中決定系統(tǒng)時鐘的因素，盡量較小時鐘的延時對保證設(shè)計的穩(wěn)定性有非常重要的意義。
  • 關(guān)鍵字： 信號時延  系統(tǒng)時鐘  FPGA  

JavaCard指令處理器的FPGA設(shè)計和實現(xiàn)

  • 給出了一種基于微碼的JavaCard指令處理器的FPGA設(shè)計和實現(xiàn)，以此JavaCard CPU為核心搭建的測試平臺已集成在一塊FPGA上實現(xiàn)。
  • 關(guān)鍵字： JavaCard  復雜指令集  FPGA  

基于FPGA的LBS控制器設(shè)計

  • 通過對LBS控制器的控制信號、LBS總線讀寫操作時序、LBS狀態(tài)機進行分析，設(shè)計并實現(xiàn)了一個高效、可靠的LBS控制器來實現(xiàn)FPGA和PEX8311的通信系統(tǒng)，在PEX8311和FPGA接口中運行狀態(tài)正常，穩(wěn)定性強，成功應(yīng)用于某視頻采集卡、某PCIe數(shù)據(jù)采集卡等，基于FPGA設(shè)計的LBS控制器具有靈活性強、可編程能力強、適應(yīng)性強等優(yōu)點。
  • 關(guān)鍵字： LBS控制器  PEX8311  FPGA  

基于FPGA的跳頻通信系統(tǒng)設(shè)計

  • 本跳頻系統(tǒng)中，F(xiàn)PGA是硬件邏輯的載體，完成基帶信號采樣后的混頻、濾波等操作及對DDS、ADC等外部邏輯的控制；dsp控制FPGA內(nèi)部邏輯以及DDS、ADC等邏輯單元完成跳頻通信系統(tǒng)基帶部分的發(fā)射與接收及其一系列計算任務(wù)；高精度時鐘源為整個系統(tǒng)提供時間基準，經(jīng)過dsp、FPGA、DDS等器件內(nèi)部鎖相環(huán)倍頻，為各器件提供主時鐘。
  • 關(guān)鍵字： 跳頻通信  基帶模塊  FPGA  

高速定點FFT算法的FPGA設(shè)計方案

  • 著重討論基于FPGA的64點高速FFT算法的實現(xiàn)方法。采用高基數(shù)結(jié)構(gòu)和流水線結(jié)構(gòu)，大大提高了FFT處理器的運行速度。同時塊浮點結(jié)構(gòu)的引入，也大幅減少了浮點操作占用FPGA器件的資源數(shù)目，兼顧了FPGA高精度、低資源、低功耗的特點。
  • 關(guān)鍵字： 高速FFT算法  高基數(shù)結(jié)構(gòu)  FPGA  流水線結(jié)構(gòu)  

基于Nios II的多媒體廣告系統(tǒng)

  • 電子屏的出現(xiàn)，不僅可以使企業(yè)更全面的展示產(chǎn)品，推廣企業(yè)文化，而且可以滿足不同讀者的需求，改善城市環(huán)境，提升人民生活質(zhì)量，更重要的是廣告能夠更及時、更準確、更全面的展示自己的新產(chǎn)品，第一時間與消費者進行溝通，贏得市場，獲取利潤，以及根據(jù)市場動態(tài)更及時更全面的做出市場決策?；谝陨显?，我們采用Nios II軟核設(shè)計了能及時發(fā)布戶外廣告、電子公告的多媒體廣告系統(tǒng)。
  • 關(guān)鍵字： NiosII處理器  多媒體廣告  FPGA  

FPGA設(shè)計者需要練好5項基本功

  • 在我看來，成為一名說得過去的FPGA設(shè)計者，需要練好5項基本功：仿真、綜合、時序分析、調(diào)試、驗證。
  • 關(guān)鍵字： 設(shè)計流程  仿真  FPGA  綜合  時序分析  

面向FPGA應(yīng)用的電源設(shè)計

  • 近幾年，F(xiàn)PGA 產(chǎn)業(yè)迅速擴張，有越來越多的工程師從事著與 FPGA 相關(guān)的設(shè)計和研發(fā)工作。作為任何一款產(chǎn)品都不可或缺的電源，也面臨來自FPGA應(yīng)用的要求和挑戰(zhàn)。一方面是需求的增多，另一方面的技術(shù)指標要求的不斷提升，如何幫助工程師輕松完成FPGA產(chǎn)品的電源設(shè)計，讓他們得以將更多的精力投入到核心部分的設(shè)計中，從而縮短設(shè)計周期，成了每個電源廠商要面對的問題。為此，筆者采訪了來自優(yōu)質(zhì)電源產(chǎn)品供應(yīng)商凌力爾特公司的DC/DC μModule 產(chǎn)品市場經(jīng)理Afshin Odabaee，來聽一聽他對面向FPGA應(yīng)用的電
  • 關(guān)鍵字： 靜態(tài)電流  散熱  FPGA  

基于EDA技術(shù)的FPGA設(shè)計

  • 對傳統(tǒng)電子系統(tǒng)設(shè)計方法與現(xiàn)代電子系統(tǒng)設(shè)計方法進行了比較，引出了基于EDA技術(shù)的現(xiàn)場可編程門陣列（FPGA）電路，提出現(xiàn)場可編程門陣列（FPGA）是近年來迅速發(fā)展的大規(guī)?？删幊虒Ｓ眉呻娐罚ˋSIC），在數(shù)字系統(tǒng)設(shè)計和控制電路中越來越受到重視。介紹了這種電路的基本結(jié)構(gòu)、性能特點、應(yīng)用領(lǐng)域及使用中的注意事項。對基于EDA技術(shù)的FPGA進行了展望。指出EDA技術(shù)將是未來電子產(chǎn)品設(shè)計技術(shù)發(fā)展的主要方向。
  • 關(guān)鍵字： 自動化設(shè)計  EDA  FPGA  

采用EDA或FPGA實現(xiàn)IP保護

  • 提出一種結(jié)合電子設(shè)計自動化(Electronic Design Automation，簡稱EDA)軟件和FPGA的IP核保護機制。通過在EDA工具中加入保護機制防止設(shè)計者非授權(quán)使用IP核，在FPGA中加入保護機制防止設(shè)計被非法復制、竊取或篡改。
  • 關(guān)鍵字： IP保護  EDA  FPGA  

基于FPGA的H.264幀內(nèi)預(yù)測模塊設(shè)計

  • 提出一種能實時處理的H.264/AVC幀內(nèi)預(yù)測硬件結(jié)構(gòu)。通過對H.264/AVC各個預(yù)測模式的分析，設(shè)計了一個通用運算單元，提高了硬件資源的可重用性。采用4個并行運算單元計算預(yù)測值，對運算比較復雜的plane模式預(yù)處理，并設(shè)計模式預(yù)測器，加快了系統(tǒng)處理速度。硬件電路結(jié)構(gòu)已通過RTL級仿真及綜合，并在Altera公司的Cyclone II FPGA平臺上進行了驗證和測試。
  • 關(guān)鍵字： H.264幀內(nèi)預(yù)測  視頻解碼器  FPGA  

基于FPGA/Nios-Ⅱ的矩陣運算硬件加速器設(shè)計

  • 針對復雜算法中矩陣運算量大,計算復雜,耗時多,制約算法在線計算性能的問題,從硬件實現(xiàn)角度,研究基于FPGA/Nios-Ⅱ的矩陣運算硬件加速器設(shè)計,實現(xiàn)矩陣并行計算。首先根據(jù)矩陣運算的算法分析,設(shè)計了矩陣并行計算的硬件實現(xiàn)結(jié)構(gòu),并在Modelsim中進行功能模塊的仿真,然后將功能模塊集成一個自定制組件,并通過Avalon總線與NiosⅡ主處理器通信,作為硬件加速器。最后在FPGA芯片中構(gòu)建SoPC系統(tǒng),并在Altera DE3開發(fā)板中進行矩陣實時計算測試。測試結(jié)果驗證了基于FPGA/Nios-Ⅱ矩陣運算硬件
  • 關(guān)鍵字： 硬件加速器  矩陣運算  FPGA  

TD-LTE綜合測試儀表關(guān)鍵模塊的研究與實現(xiàn)

  • 在對OFDM調(diào)制以及FPGA、DSP、中頻接口進行深入研究的基礎(chǔ)上，提出了一種TD-LTE系統(tǒng)中下行鏈路基帶信號發(fā)送的實現(xiàn)方案，在系統(tǒng)的設(shè)計思路和硬件資源上進行了優(yōu)化。在實際的硬件環(huán)境下，通過大量測試，驗證了該方案的可行性和有效性。
  • 關(guān)鍵字： TD-LTE  基帶信號發(fā)送  FPGA  
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