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EEPW首頁 >> 主題列表 >> fsp:fpga-pcb

一種基于FPGA 的嵌入式塊SRAM 的設(shè)計

  • 摘　要：文章中提出了一種應(yīng)用于FPGA 的嵌入式可配置雙端口的塊存儲器。該存儲器包括與其他電路的布線接口、可配置邏輯、可配置譯碼、高速讀寫電路。在編程狀態(tài)下，可對所有存儲單元進行清零，且編程后為兩端口獨
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基于FPGA的語音存儲與回放系統(tǒng)設(shè)計

  • 1 設(shè)計要求　　設(shè)計并制作一個數(shù)字化語音存儲與回放系統(tǒng)，其示意圖如圖1所示。

    圖1 數(shù)字化語音存儲與回放系統(tǒng)示意圖　　(1)放大器1的增益為46dB，放大器2的增益為40dB，增益均可調(diào)；　　(2)帶通濾波器：通帶為30
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基于FPGA 與VHDL 的微型打印機的驅(qū)動設(shè)計

  • 摘 要：為了取代傳統(tǒng)利用單片機驅(qū)動微型打印機，使用Alt era 公司的FPGA 芯片EP3C25Q240C8N 設(shè)計驅(qū)動打印機的硬件控制電路，并正確控制微型打印機的工作時序。軟件使用硬件描述語言VH DL 實現(xiàn)對微型打印機的時序控
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基于FPGA 的衛(wèi)星便攜站的同步數(shù)字復(fù)接器的設(shè)計

  • 在便攜式數(shù)字衛(wèi)星通信系統(tǒng)中，為了擴大傳輸容量和提高傳輸效率，滿足同時傳輸幾種業(yè)務(wù)的需求，通常采用時分復(fù)用的方法，將若干個低速數(shù)字碼流按一定格式合并成一個高速數(shù)據(jù)碼流，以便在一條信道中傳輸，使各個業(yè)務(wù)信
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根升余弦脈沖成形濾波器FPGA實現(xiàn)

  • 摘要：提出了基于電路分割技術(shù)實現(xiàn)通信系統(tǒng)發(fā)送端根升余弦波形成形濾波器查表法的FPGA結(jié)構(gòu)，節(jié)省了ROM單元，討論了其ROM初始化時形波數(shù)據(jù)的組織方法，完成了該結(jié)構(gòu)的VHDL實現(xiàn)，給出了該設(shè)計在Modelsim環(huán)境下的時序仿
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市場需求推動FPGA、CPU、DSP走向融合

  • 　　實際上，推動某項或幾項技術(shù)發(fā)展方向的真正動力是市場與技術(shù)的綜合因素，技術(shù)本身或內(nèi)在的發(fā)展慣性并不是最重要的，或者說并非唯一決定性因素。 　　
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用PQFN封裝技術(shù)提高能效和功率密度

  • 當(dāng)今大多數(shù)電子產(chǎn)品設(shè)計都要求高能源效率，包括非消費型電子設(shè)備在內(nèi)，例如工業(yè)馬達驅(qū)動器和電信網(wǎng)絡(luò)基礎(chǔ)設(shè)施。對于電源而言，同樣需要高功率密度和可靠性，以便降低總擁有成本?！　‰S著開關(guān)模式電源轉(zhuǎn)換成為業(yè)界
  • 關(guān)鍵字： PCB  電源  

Altera開始提供業(yè)界第一款集成EFEC解決方案

  • 　　Altera公司日前宣布，開始提供業(yè)界第一款集成增強前向糾錯(EFEC) IP內(nèi)核，該內(nèi)核針對高性能Stratix IV和Stratix V系列FPGA進行了優(yōu)化。EFEC7和EFEC20是Altera Newfoundland技術(shù)中心 (以前的Avalon Microelectronics) 開發(fā)的多維IP內(nèi)核，專門面向城域和長距離光傳送網(wǎng)(OTN)等100G應(yīng)用而設(shè)計?！?/li>
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基于FPGA的大動態(tài)數(shù)控AGC系統(tǒng)設(shè)計

  • 隨著軟件無線電技術(shù)和FPGA、DSP、AD 等技術(shù)的高速發(fā)展，數(shù)字接收機的應(yīng)用日益廣泛。為了擴大數(shù)字接收機的ADC 動態(tài)范圍，廣泛采用了自動增益控制(AGC) ，使接收機的增益隨著信號的強弱進行調(diào)整，其性能的好壞直接
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基于FPGA的視頻采集與顯示模塊設(shè)計

  • 本文給出的視頻采集和顯示模塊在設(shè)計時，選取分辨率為768times;494像素的NTSC制式， 并選用輸出像素為640times;480的CCD攝像頭； FPGA選取Altera CyclONeⅡ系列Ep2c35F672c36 (內(nèi)含35000個邏輯單元)； 主動串行配
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基于FPGA的測角脈沖細分電路的設(shè)計

  • 摘要：對傳統(tǒng)的數(shù)字化轉(zhuǎn)角測量方法進行了簡要介紹，提出了一種能夠提高測角分辨率的脈沖細分技術(shù)，并結(jié)合激光陀螺輸出信號對該方法進行了誤差分析。接著利用FPGA對此項技術(shù)進行了硬件實現(xiàn)，具體描述了電路各部分的工
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列車用高速數(shù)字PCB電路板抗干擾設(shè)計

  • 摘 要:詳細闡明了高速數(shù)字印制電路板在設(shè)計時應(yīng)該注意的問題，闡明了在列車車載系統(tǒng)中高速數(shù)字電路將會受到哪些方面的影響，以及產(chǎn)生這些影響的原因，針對具體問題提出設(shè)計高速電路時應(yīng)該采取的幾種方法。實踐證明，
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基于FPGA和DDS技術(shù)的任意波形發(fā)生器設(shè)計

  • 摘要：根據(jù)現(xiàn)代電子系統(tǒng)對信號源的頻率穩(wěn)定度、準(zhǔn)確度及分辨率越來越高的要求，結(jié)合直接數(shù)字式頻率合成器(DDS)的優(yōu)點，利用FPGA芯片的可編程性和實現(xiàn)方案易改動的特點，提出了一種基于FPGA和DDS技術(shù)的任意波形發(fā)生器
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基于FPGA與VHDL的微型打印機的驅(qū)動設(shè)計

  • 摘要：為了取代傳統(tǒng)利用單片機驅(qū)動微型打印機，使用Altera公司的FPGA芯片EP3C225Q240C8N設(shè)計驅(qū)動打印機的硬件控制電路，并正確控制微型打印機的工作時序。軟件使用硬件描述語言VHDL實現(xiàn)對微型打印機的時序控制，并通
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基于FPGA的數(shù)字示波器

  • 摘要：提出一種基于FPGA的簡易數(shù)字示波器設(shè)計方法，硬件上采用以Altera公司的EP2C8Q208CN現(xiàn)場可編程門陣列芯片作為核心器件，同時結(jié)合FPGA和NIOS軟核的優(yōu)勢，設(shè)計高效的片上可編程系統(tǒng)(SoPC)對高速A／D所采集的數(shù)據(jù)進
  • 關(guān)鍵字： FPGA  數(shù)字示波器    
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