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EEPW首頁 >> 主題列表 >> fsp:fpga-pcb

基于AD9957的USB側音測距信號發(fā)生器設計

  • 　　0 引言 　　隨著我國航天技術的不斷進步，深空測距技術受到越來越多的關注。在深空測距系統(tǒng)中，中頻信號發(fā)生器對系統(tǒng)性能有著重要的意義。在USB(統(tǒng)一S頻段)系統(tǒng)中，原有的模擬電路實現(xiàn)的發(fā)射模塊存在性能不完善、輸入動態(tài)范圍小、可控性能差、不能適應中心頻率大范圍變化、體積大等問題，為了解決上述問題，可在一個標準化通用數(shù)字調(diào)制信號發(fā)生器的平臺上，通過外圍的控制電路，實現(xiàn)對載波中心頻率、輸出功率、調(diào)相指數(shù)、測距音通／斷控制等參數(shù)的改變。 　　以軟件無線電思想為核心，基于PLD(可編程邏輯器件)的通用調(diào)制信號
  • 關鍵字： 測距  模擬電路  USB  無線電  FPGA  

基于TMS320C6205的信號采集處理系統(tǒng)

  • 　　0引言 　　典型的DSP(數(shù)字信號處理器)內(nèi)部采用改進的哈佛結構和流水線技術，可以在單指令周期內(nèi)完成乘加運算，具有較高的處理能力。一個典型的基于DSP的信號采集處理系統(tǒng)，通常由DSP、A／D轉換器、存儲器和相應的接口電路組成，大都做成PCI(外設部件互連)接口插卡形式和主控計算機一起工作。各種控制信息通過PCI發(fā)送給DSP，采集處理后的結果再通過PCI接口發(fā)送回主控計算機。PCI接口部分一般需要采用接口芯片來完成，這樣會顯著增加系統(tǒng)的設計調(diào)試難度，并使成本增加。而選用本身帶有PCI接口的DSP處理芯
  • 關鍵字： DSP  TMS320C6205  信號采集  處理器  FPGA  

基于DSP的信號采集處理系統(tǒng)

  • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡家園
  • 關鍵字： DSP  TMS320C6205  FPGA  信號采集  處理器  

高速數(shù)字隔離型串行ADC及其工程應用

  • 　　1．引言  　　目前，逆變器在很多領域有著越來越廣泛地應用。對逆變器的研究具有十分重要的意義和廣闊的工程應用前景。常見逆變技術的控制方法大致分為開環(huán)控制的載波調(diào)制方法和閉環(huán)控制的跟蹤控制方法。跟蹤控制方法屬于閉環(huán)控制，閉環(huán)反饋中的檢測環(huán)節(jié)需要與高壓主電路相互隔離，避免高壓側電磁噪聲對控制電路的竄擾。高性能的跟蹤型逆變器對反饋量的實時性要求很高，因此要求反饋環(huán)節(jié)具有高速隔離傳輸模擬信號的能力。 　　目前，最常用的隔離技術可以分為線性隔離和數(shù)字隔離。線性隔離器存在溫度漂移、線性度差，魯棒
  • 關鍵字： 逆變器  隔離  FPGA  SPWM  ADC  

NI LabVIEW軟件平臺用智能多核加速了設計與測試

  • 　　NI 隆重發(fā)布了可應用于控制、測試及嵌入式系統(tǒng)開發(fā)的圖形化系統(tǒng)設計平臺的最新版本 -- LabVIEW 8.6。得益于 LabVIEW 軟件平臺天生并行的圖形化編程方式, LabVIEW 8.6版本提供了全新工具幫助工程師和科學家們從多核處理器、現(xiàn)場可編程門陣列 (FPGAs) 及無線通信等商業(yè)技術中獲益。 　　為了提升性能, LabVIEW 8.6包含了超過1,200個重新優(yōu)化的高級分析函數(shù),在多核系統(tǒng)的控制測試應用中提供更快速、更強大的數(shù)學及信號處理功能。視覺應用同樣能從多核系統(tǒng)中獲益,NI 視
  • 關鍵字： NI  LabVIEW  FPGA  多核處理器  

采用EEPROM對大容量FPGA芯片數(shù)據(jù)實現(xiàn)串行加載

  • 　　自大規(guī)?，F(xiàn)場可編程邏輯器件問世以來，先后出現(xiàn)了兩類器件，一類是基于SRAM體系結構的FPGA系列，如XILINX公司的4000系列和最新的Virtex系列；另一類是基于faxtFLASH技術的CPLD器件，如XILINX公司的9500系列和Lattice公司的ispLSxx系列芯片。FPGA具有容量大、設計資源豐富、片內(nèi)ROM及RAM設計靈活等特點1，但是它們需要在每次上電時進行數(shù)據(jù)加載。目前實現(xiàn)加載的方法有以下三種：①采用PROM并行加載；②采用專用SROM串行加載；③采用單片機控制實現(xiàn)加載。 　
  • 關鍵字： FPGA  XILINX  CPLD  數(shù)據(jù)加載  EEPROM  

基于USB的ARINC429總線接口模塊設計

  • 　　引言  　　ARINC429總線由美國航天無線電設備公司所資助，是廣泛應用于當前航空電子設備中的一種數(shù)據(jù)總線傳輸標準。與傳統(tǒng)的航空電子設備間的模擬傳輸相比，ARINC429總線具有抗干擾能力強、傳輸精度高、傳輸線路少以及成本低等優(yōu)點。ARINC數(shù)據(jù)總線協(xié)議規(guī)定一個數(shù)據(jù)由32位組成，采用雙極性歸零碼，以12.5Kb/s或100Kb/s碼速率傳輸。本設計利用USB即插即用、FPGA可靈活配置等特點，設計了基于USB總線的ARINC429總線接口模塊。 　　接口模塊總體設計結構 　　接口
  • 關鍵字： 接口  FPGA  USB  總線  

基于AD9957的USB側音測距信號發(fā)生器設計

  • 　　0 引言 　　隨著我國航天技術的不斷進步，深空測距技術受到越來越多的關注。在深空測距系統(tǒng)中，中頻信號發(fā)生器對系統(tǒng)性能有著重要的意義。在USB(統(tǒng)一S頻段)系統(tǒng)中，原有的模擬電路實現(xiàn)的發(fā)射模塊存在性能不完善、輸入動態(tài)范圍小、可控性能差、不能適應中心頻率大范圍變化、體積大等問題，為了解決上述問題，可在一個標準化通用數(shù)字調(diào)制信號發(fā)生器的平臺上，通過外圍的控制電路，實現(xiàn)對載波中心頻率、輸出功率、調(diào)相指數(shù)、測距音通／斷控制等參數(shù)的改變。 　　以軟件無線電思想為核心，基于PLD(可編程邏輯器件)的通用調(diào)制信號
  • 關鍵字： 測距  PLD  USB  D／A  FPGA  

基于FPGA的自然對數(shù)變換器的設計與實現(xiàn)

  • 本文利用CORD IC算法在FPGA上實現(xiàn)了自然對數(shù)運算器。實驗結果表明該對數(shù)運算器的輸出誤差為10-4數(shù)量級，最高頻率可達到80MHz。該運算器適用于高速大數(shù)據(jù)量的數(shù)據(jù)處理。
  • 關鍵字： FPGA  對數(shù)運算  CORD IC算法  對數(shù)變換器  200808  

IC業(yè)在拐點生存

  • 分析了IC業(yè)的眾多特點，例如從90nm向65nm、45nm、32nm、22nm等拐點演進的困難，以及ESL、DFM拐點，制造是設計的拐點，F(xiàn)PGA與ASIC之間的拐點等熱門問題。
  • 關鍵字： EDA  65nm  45nm  22nm  光刻  處理器  FPGA  ASIC  200808  

基于FPGA和AD1836的I2S接口設計

  • 本文以FPGA為控制單元，完成了AD1836中D/A部分的I2S接口設計，它在數(shù)字音頻系統(tǒng)的設計中有一定的參考和實用價值。該設計已經(jīng)成功運用在某話路特性綜合測試系統(tǒng)中，性能良好。
  • 關鍵字： FPGA  1836  I2S  AD    

Altera FPGA開發(fā)板為XLoom提供誤碼率測試環(huán)境

  • 　　進一步展示其FPGA靈活性和通用性，Altera公司宣布，XLoom通信公司采用Stratix® II GX FPGA信號完整性開發(fā)套件來提供獨特的誤碼率(BER)測試環(huán)境。和傳統(tǒng)的BER測試設備相比，Altera基于FPGA的開發(fā)板支持XLoom以更高的性價比來測試芯片級光電互聯(lián)模塊。這一獨特的測試環(huán)境更貼近實際的客戶狀態(tài)，同時進一步節(jié)省了空間，降低了功耗。 　　傳統(tǒng)的BER測試儀成本高達100,000美元，而Stratix II GX FPGA信號完整性開發(fā)套件在這方面的成本節(jié)省了90％
  • 關鍵字： Altera  FPGA  開發(fā)套件  XLoom  

基于FPGA的空間存儲器的糾錯系統(tǒng)

  • 　　1、引言 　　阿爾法磁譜儀(Alpha Magnetic Spectrometer，AMS)實驗室是丁肇中博士領導的由美、俄、德、法、中等16個國家和地區(qū)共300多名科學家參加的大型國際合作項目。它是國際空間站上唯一大型物理實驗，是人類第一次在太空中精密地測量高能量帶電原子核粒子的實驗。其目的是為尋找反物質所組成的宇宙和暗物質的來源以及測量宇宙線的來源。 　　但是對于AMS實驗的空間電子系統(tǒng)，同樣會受到高能粒子的襲擊，導致存儲器的內(nèi)容發(fā)生變化，改寫半導體存儲器件的邏輯狀態(tài)，導致存儲單元在邏輯&ls
  • 關鍵字： FPGA  存儲器  AMS  編碼  譯碼  

在低成本測試夾具上實現(xiàn)對表面貼裝射頻元器件的精確去嵌入

  • 　　簡介 　　射頻工程師通常使用矢量網(wǎng)絡分析儀（VNA）測量射頻元器件的S參數(shù)，以便對其特性進行表征并進行后續(xù)設計。他們在測量過程中遇到的一個問題是，這些元器件往往是表貼封裝的，不能直接與VNA連接。如圖1所示，工程師通常會制作簡單的PCB測試夾具來對被測件（DUT）進行表面貼裝，建立被測件與VNA的連接。但是，這樣的測試夾具本身會給S參數(shù)測量帶來寄生效應，必須通過一個稱為去嵌入的過程來去除這種效應。 圖1 PCB測試夾具對被測件（DUT）進行表面貼裝 　　本文描述了一個實用的去嵌入過程，它不需
  • 關鍵字： 射頻  PCB  夾具  去嵌入  

Actel推出Libero集成開發(fā)環(huán)境 8.4

  • 　　Actel公司宣布其Libero® 集成開發(fā)環(huán)境 （IDE） 增添全新的功耗優(yōu)化和增強的設計創(chuàng)建功能。全新的Libero IDE 8.4針對基于 Flash的IGLOO®、IGLOO PLUS和 ProASIC®3L現(xiàn)場可編程門陣列 （FPGA），提供由1.14V至 1.575V的FPGA內(nèi)核工作電壓范圍，為設計人員提供額外的內(nèi)核電壓選擇，以實現(xiàn)更低的功耗。新版本Libero IDE改進了SmartPower功耗分析工具，便于比較同一設計的多種設計實現(xiàn)和器件不同工作條件下的狀況
  • 關鍵字： Actel  IDE  Libero  FPGA  集成開發(fā)環(huán)境  
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