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I2C串行總線協(xié)議的VHDL實現(xiàn)

  • 分析了I2C串行總線的數(shù)據(jù)傳輸機(jī)制，用VHDL設(shè)計了串行總線控制電路，其中包括微處理器接口電路和I2C總線接口電路。采用ModelSim Plus 6.0 SE軟件進(jìn)行了前仿真和調(diào)試,并在Xilinx ISE 7.1i開發(fā)環(huán)境下進(jìn)行了綜合、后仿真和CPLD器件下載測試。 結(jié)果表明實現(xiàn)了I2C串行總線協(xié)議的要求。
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1553B多功能RT IP核的設(shè)計與實現(xiàn)

  • 介紹了采用一種自主研發(fā)多功能IP核實現(xiàn)總線全地址響應(yīng)的設(shè)計方案,其可在FPGA中靈活配置,配備外圍電路后可以方便實現(xiàn)各種功能.設(shè)計采用VHDL硬件描述語言進(jìn)行編程,采用綜合工具ISE Foundation對設(shè)計進(jìn)行綜合、優(yōu)化,在ModelSim - SE 6.1g中進(jìn)行時序仿真,并且最后在FPGA上實現(xiàn).
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基于FPGA的鍵盤輸入累計存儲IP核的設(shè)計與驗證

  • 基于FPGA設(shè)計了一款通用鍵盤IP核,該核主要實現(xiàn)對鍵盤輸入信號的計算與存儲功能,并在quartusⅡ環(huán)境下使用VHDL語言,采用自頂向下設(shè)計方式,編輯生成RTL原理圖,并做了相關(guān)的時序仿真驗證。經(jīng)驗證此IP核具有較強(qiáng)的魯棒性和較高的反應(yīng)速度,可作為基礎(chǔ)輸入模塊,為其他模塊提供有力控制輸入與數(shù)據(jù)支持。
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基于FPGA的QPSK調(diào)制解調(diào)的系統(tǒng)仿真

  • 本文針對傳統(tǒng)的四相移鍵控(QPSK)的調(diào)制解調(diào)方式提出一種基于高速硬件描述語言(VHDL)的數(shù)字式QPSK調(diào)制解調(diào)模型。這種新模型便于在目標(biāo)芯片F(xiàn)PGA/CPLD上實現(xiàn)QPSK調(diào)制解調(diào)功能。文中介紹了QPSK調(diào)制解調(diào)的原理,并基于FPGA實現(xiàn)了QPSK調(diào)制解調(diào)電路。并給出了可編程邏輯器件FPGA的最新一代集成設(shè)計環(huán)境QuartusⅡ進(jìn)行系統(tǒng)仿真的仿真結(jié)果。
  • 關(guān)鍵字： 四相移鍵控  VHDL  調(diào)制解調(diào)模型  

基于FPGA的數(shù)字溫度測量儀設(shè)計

  • 溫度測量儀是一種常用的檢測儀器，文章中利用FPGA器件和DS18B20傳感器設(shè)計實現(xiàn)了一種數(shù)字溫度測量儀，用于室溫的檢測。該測量儀具有結(jié)構(gòu)簡單、抗干擾能力強(qiáng)、精確性高、轉(zhuǎn)換速度快、擴(kuò)展性好等優(yōu)點。
  • 關(guān)鍵字： 溫度傳感器  VHDL  FPGA  

VHDL設(shè)計電路優(yōu)化問題

  • 近年來，隨著集成電路技術(shù)和EDA技術(shù)的不斷發(fā)展，集設(shè)計、模擬、綜合和測試功能為一體的VHDL語言，已作為IEEE標(biāo)準(zhǔn)化的硬件描述語言。因此，對VHDL設(shè)計中簡化電路結(jié)構(gòu)，優(yōu)化電路設(shè)計的問題進(jìn)行深入探討，很有必要。
  • 關(guān)鍵字： 電路優(yōu)化  VHDL  硬件描述  

基于VHDL+FPGA的自動售貨機(jī)控制模塊的設(shè)計與實現(xiàn)

  • EDA技術(shù)是以計算機(jī)為工具完成數(shù)字系統(tǒng)的邏輯綜合、布局布線和設(shè)計仿真等工作。電路設(shè)計者只需要完成對系統(tǒng)功能的描述，就可以由計算機(jī)軟件進(jìn)行系統(tǒng)處理，最后得到設(shè)計結(jié)果，并且修改設(shè)計方案如同修改軟件一樣方便。
  • 關(guān)鍵字： VHDL  EDA  FPGA  

基于FPGA的VHDL語言電路優(yōu)化設(shè)計

  • 在VHDL語言電路優(yōu)化設(shè)計當(dāng)中，優(yōu)化問題主要包括面積優(yōu)化和速度優(yōu)化。面積優(yōu)化是指CPLD／FPGA的資源利用率優(yōu)化，即用盡可能少的片內(nèi)資源實現(xiàn)更多電路功能；速度優(yōu)化是指設(shè)計系統(tǒng)滿足一定的速度要求。
  • 關(guān)鍵字： 電路優(yōu)化設(shè)計  VHDL  FPGA  

基于VHDL的洗衣機(jī)控制器的設(shè)計

  • 摘要：為降低設(shè)計成本，縮短設(shè)計周期，提出一種基于VHDL的洗衣機(jī)控制器的設(shè)計方案。該方案采用模塊化的設(shè)計思想，并使用狀態(tài)機(jī)完成控制模塊的設(shè)計。整個系統(tǒng)在QuartusⅡ開發(fā)平臺上完成設(shè)計、編譯和仿真，并在FPGA硬件
  • 關(guān)鍵字： 洗衣機(jī)控制器  狀態(tài)機(jī)  FPGA  VHDL  QuartusⅡ  

CPLD實現(xiàn)GPIB控制器的設(shè)計

  • 作者：魏金成　牟濤1. 引言：1.1用 CPLD 實現(xiàn) GPIB 控制芯片的意義綜觀現(xiàn)今市場上的測試儀器，不難發(fā)現(xiàn) GPIB總線有重要的作用，在研制臺式測試儀器的時候，客戶幾乎均要求具備 GPIB接口?？墒窃趯嶋H研發(fā)過程中，卻發(fā)
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UART 16倍頻采樣的VHDL實現(xiàn)

  • 概述隨著電子設(shè)計自動化(EDA)技術(shù)的發(fā)展，可編程邏輯器件FPGA/CPLD已經(jīng)在許多方面得到了廣泛應(yīng)用，而UART(通用異步收發(fā)器) 是在數(shù)字通信和控制系統(tǒng)中廣泛使用的串行數(shù)據(jù)傳輸協(xié)議。因此越來越多用戶根據(jù)自己的需要，
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VHDL設(shè)計進(jìn)階:邏輯綜合的原則以及可綜合的代碼設(shè)計風(fēng)格

  • 4.5.1 always塊語言指導(dǎo)原則使用always塊進(jìn)行可綜合的代碼設(shè)計時需要注意以下幾個問題。(1)每個always塊只能有一個事件控制“@(event-expression)”，而且要緊跟在always關(guān)鍵字后面。(2)always塊可以表示
  • 關(guān)鍵字： VHDL  進(jìn)階  代碼設(shè)計  邏輯    

用于VHDL的DRAM控制器設(shè)計

  • 80C186XL16位嵌入式微處理器是Intel公司在嵌入式微處理器市場的上導(dǎo)產(chǎn)品之一，已廣泛應(yīng)用于電腦終端、程控交換和工控等領(lǐng)域。在該嵌入式微處理器片內(nèi)，集成有DRAM RCU單元，即DRAM刷新控制單元。RCU單元可以自動產(chǎn)
  • 關(guān)鍵字： 80C186XL    CPLD    DRAM控制器    VHDL  

基于CPLD／FPGA的VHDL語言電路優(yōu)化設(shè)計

  • 杜志傳，鄭建立(上海理工大學(xué) 醫(yī)療器械與食品學(xué)院 上海 200093)0 引 言VHDL(Very High Speed Integrated Circuit Hardware Description Language)是IEEE工業(yè)標(biāo)準(zhǔn)硬件描述語言，是隨著可編程邏輯器件(PLD)的發(fā)展而發(fā)
  • 關(guān)鍵字： VHDL  CPLD／FPGA  電路設(shè)計  優(yōu)化  

CPLD電梯運行控制器VHDL

  • 西安航空職業(yè)技術(shù)學(xué)院 李軍法1 引言隨著社會的發(fā)展。使用電梯越來越普遍，已從原來只在商業(yè)大廈、賓館過渡到在辦公室、居民樓等多種建筑中，并且對電梯功能的要求也不斷提高，其相應(yīng)控制方式也在不斷發(fā)生變化。電梯的
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